研究会情報 |
研究会 |
ICD |
開催期間 |
2005-12-15 - 2005-12-16 |
開催地(和) |
高知工科大 |
開催地(英) |
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テーマ(和) |
回路技術(一般、超高速・低電力・高機能を目指した新アーキテクチュア) (オーガナイザ:西谷隆夫(高知工科大学)) |
テーマ(英) |
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講演論文情報の詳細 |
申込み研究会 |
ICD |
会議コード |
2005-12-ICD |
本文の言語 |
日本語 |
タイトル(和) |
チップ内パケットデータ転送方式に基づくVLSIプロセッサアーキテクチャ |
サブタイトル(和) |
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タイトル(英) |
VLSI Processor Architecture Based on Intra-Chip Packet Data Transfer Scheme |
サブタイトル(英) |
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キーワード(1)(和/英) |
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キーワード(2)(和/英) |
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キーワード(3)(和/英) |
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キーワード(4)(和/英) |
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キーワード(6)(和/英) |
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キーワード(7)(和/英) |
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キーワード(8)(和/英) |
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第1著者 氏名(和/英/ヨミ) |
藤岡 与周 / Yoshichika Fujioka / フジオカ ヨシチカ |
第1著者 所属(和/英) |
八戸工業大学 (略称: 八戸工大)
Hachinohe Institute of Technology (略称: Hachinohe Inst. of Tech.) |
第2著者 氏名(和/英/ヨミ) |
苫米地 宣裕 / Nobuhiro Tomabechi / トマベチ ノブヒロ |
第2著者 所属(和/英) |
八戸工業大学 (略称: 八戸工大)
Hachinohe Institute of Technology (略称: Hachinohe Inst. of Tech.) |
第3著者 氏名(和/英/ヨミ) |
亀山 充隆 / Michitaka Kameyama / カメヤマ ミチタカ |
第3著者 所属(和/英) |
東北大学 (略称: 東北大)
Tohoku University (略称: Tohoku Univ.) |
第4著者 氏名(和/英/ヨミ) |
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第4著者 所属(和/英) |
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第5著者 氏名(和/英/ヨミ) |
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第5著者 所属(和/英) |
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第6著者 氏名(和/英/ヨミ) |
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第7著者 氏名(和/英/ヨミ) |
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第8著者 氏名(和/英/ヨミ) |
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第9著者 氏名(和/英/ヨミ) |
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第10著者 氏名(和/英/ヨミ) |
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第11著者 氏名(和/英/ヨミ) |
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第12著者 氏名(和/英/ヨミ) |
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第13著者 氏名(和/英/ヨミ) |
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第14著者 氏名(和/英/ヨミ) |
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第15著者 氏名(和/英/ヨミ) |
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第16著者 氏名(和/英/ヨミ) |
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第17著者 氏名(和/英/ヨミ) |
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第18著者 氏名(和/英/ヨミ) |
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第19著者 氏名(和/英/ヨミ) |
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第20著者 氏名(和/英/ヨミ) |
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第20著者 所属(和/英) |
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講演者 |
第1著者 |
発表日時 |
2005-12-15 11:45:00 |
発表時間 |
25分 |
申込先研究会 |
ICD |
資料番号 |
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巻番号(vol) |
vol.105 |
号番号(no) |
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ページ範囲 |
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ページ数 |
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発行日 |
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