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VLSI設計技術研究会(VLD) [schedule] [select]
専門委員長 池田 誠 (東大)
副委員長 澁谷 利行 (富士通研)
幹事 中武 繁寿 (北九州市大), 峯岸 孝行 (三菱電機)

集積回路研究会(ICD) [schedule] [select]
専門委員長 山村 毅 (富士通研)
副委員長 藤島 実 (広島大)
幹事 松岡 俊匡 (阪大), 渡辺 理 (東芝)
幹事補佐 大内 真一 (産総研), 吉田 毅 (広島大), 土谷 亮 (京大), 範 公可 (電通大)

画像工学研究会(IE) [schedule] [select]
専門委員長 藤井 俊彰 (名大)
副委員長 高村 誠之 (NTT), 浜本 隆之 (東京理科大)
幹事 久保田 彰 (中大), 市ヶ谷 敦郎 (NHK)
幹事補佐 三功 浩嗣 (KDDI研), 松尾 翔平 (NTT)

システムLSI設計技術研究会(IPSJ-SLDM) [schedule] [select]
主査 村岡 道明 (高知大)
幹事 岩田 直樹 (ソニー), 島村 光太郎 (日立), 杉原 真 (九大)

日時 2013年10月 7日(月) 10:30 - 16:55
2013年10月 8日(火) 09:00 - 12:15
議題 システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,および一般 
会場名 弘前大学 コラボ弘大 八甲田ホール 
住所 〒036-8561 青森県弘前市文京町3 コラボ弘大3F
交通案内 http://www.hirosaki-u.ac.jp/access/access.html
会場世話人
連絡先
弘前大学大学院理工学研究科 今井雅

10月7日(月) 午前  VLD(1)
座長: 黒川 敦 (弘前大)
10:30 - 11:45
(1)
VLD
10:30-10:55 メモリをベースにした省電力MCU内蔵フィールドプログラマブルデバイス ○松村哲哉(日大)・川村嘉郁(ルネサス エレクトロニクス)・岡田尚也(金沢大)・有本和民(岡山県立大)・牧野博之(阪工大)・松田吉雄(金沢大)
(2)
VLD
10:55-11:20 2相ハンドシェイクプロトコル非同期式回路向けマルチクロック・マルチエッジトリガ・フリップフロップの提案 ○今井 雅(弘前大)・米田友洋(NII)
(3)
VLD
11:20-11:45 Dualパイプライン型自己同期回路の自動設計フローの構築 ○伊東 敦・池田 誠(東大)
  11:45-13:00 昼食 ( 75分 )
10月7日(月) 午後  招待講演(1)
座長: 村岡 道明 (高知大)
13:00 - 14:00
(4)
VLD
13:00-14:00 [招待講演]画像コーデックLSIの技術動向と研究成果 ○後藤 敏(早大)
  14:00-14:20 休憩 ( 20分 )
10月7日(月) 午後  招待講演(2)
座長: 池田 誠 (東大)
14:20 - 15:20
(5)
VLD
14:20-15:20 [招待講演]HEVC/H.265の標準化動向とエンコーダ開発事例 ○坂手寛治・本山信明(三菱電機)
  15:20-15:40 休憩 ( 20分 )
10月7日(月) 午後  IE/ICD(1)
座長: 市ヶ谷 敦郎 (NHK)
15:40 - 16:55
(6)
IE
15:40-16:05 “額縁形探索窓”を採用した8K-UHDTV向け速超高速動きベクトル検出アルゴリズム ○関 健太郎・榎本忠儀(中大)
(7)
ICD
16:05-16:30 3×倍速実時間6万語彙連続音声認識のための40-nm, 54-mW音声認識専用プロセッサ ○何 光霽・宮本優貴・松田薫平・和泉慎太郎・川口 博・吉本雅彦(神戸大)
(8)
ICD
16:30-16:55 集合演算プロセッサー(SOP) ~ 画像認識への応用 ~ ○井上克己(エイ・オー・テクノロジーズ)・レ ドゥクフン・曽和将容・範 公可(電通大)
10月8日(火) 午前  VLD(2)
座長: 杉原 真 (九大)
09:00 - 10:15
(9)
VLD
09:00-09:25 製造後遅延調整機能を持つRDRアーキテクチャ向け高位合成手法の評価 ○萩尾勇太・柳澤政生・戸川 望(早大)
(10)
VLD
09:25-09:50 スキャンシグネチャを用いたLED暗号へのスキャンベース攻撃 ○藤代美佳・柳澤政生・戸川 望(早大)
(11)
VLD
09:50-10:15 セレクタ論理を利用したバイリニア補間演算器設計と評価 ○塩 雅史・柳澤政生・戸川 望(早大)
  10:15-10:35 休憩 ( 20分 )
10月8日(火) 午前  ICD/VLD(1)
座長: 山村 毅 (富士通研)
10:35 - 12:15
(12)
ICD
10:35-11:00 New Architecture for Multiple-Valued Fine-Grain Reconfigurable VLSI Based on Current-Mode Logic ○Xu Bai・Michitaka Kameyama(Tohoku Univ.)
(13)
ICD
11:00-11:25 ワード線電位を適応的に降圧して読み出しマージンを拡大した低電圧動作6Tr CMOS SRAM ○小林伸彰・榎本忠儀(中大)
(14)
VLD
11:25-11:50 A Delay-Locked Loop with Multi-Level Channel Length Decomposed Programming Delay Elements Yu Zhang・Mingyu Li・Qing Dong・○Shigetoshi Nakatake(Univ. of Kitakyushu)・Bo Yang(Design Algorithm Lab)
(15)
VLD
11:50-12:15 A 9-bit, 20MS/s SAR ADC with A Design Strategy by Synthesizing Consideration of Layout-Dependent Effects ○Gong Chen・Mingyu Li・Qing Dong・Shigetoshi Nakatake(Univ. of Kitakyushu)・Bo Yang(Design Algorithm Lab)

講演時間
一般講演発表 20 分 + 質疑応答 5 分

問合先と今後の予定
VLD VLSI設計技術研究会(VLD)   [今後の予定はこちら]
問合先 中武繁寿 (北九州市大)
E--mail: k-u 
お知らせ ◎VLD研究会ホームページもご覧下さい.
http://www.ieice.org/~vld/
ICD 集積回路研究会(ICD)   [今後の予定はこちら]
問合先 渡辺理 (東芝)
E--mail:o7beba 
IE 画像工学研究会(IE)   [今後の予定はこちら]
問合先 市ヶ谷 敦郎(NHK)
E--mail: ie-n2013 
IPSJ-SLDM システムLSI設計技術研究会(IPSJ-SLDM)   [今後の予定はこちら]
問合先 杉原 真 (九大)
Email gislrckshu-u 
お知らせ ◎SLDM研究会ホームページもご覧下さい.
http://www.sig-sldm.org/


Last modified: 2013-10-08 10:37:05


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