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VLSI設計技術研究会(VLD) [schedule] [select]
専門委員長 木村 晋二
副委員長 浜村 博史
幹事 松永 裕介, 澁谷 利行

システムLSI設計技術研究会(IPSJ-SLDM) [schedule] [select]
主査 神戸 尚志
幹事 枝廣 正人, 大西 充久, 浜口 清治

日時 2006年 5月11日(木) 14:00 - 17:00
2006年 5月12日(金) 09:00 - 14:30
議題 システム設計および一般 
会場名 愛媛大学 総合情報メディアセンター 
会場世話人
連絡先
愛媛大学 工学部 情報工学科 高橋 寛
089-927-9957
お知らせ ◎11日研究会終了後,懇親会を予定していますのでご参加ください.

5月11日(木) 午後  FPGA・低消費電力設計・システムレベル合成
14:00 - 16:00
(1) 14:00-14:30 Online FPGA Placement Using I/O Routing Information Mitsuru Tomono・○Masaki NakanishiShigeru YamashitaNAIST)・Kazuo NakajimaUniv. of Maryland)・Katsumasa WatanabeNAIST
(2) 14:30-15:00 動的再構成可能配線について 木村晋二早大
(3) 15:00-15:30 オペランドのビット幅を考慮したソフトウェアレベル消費エネルギー削減手法 山口誠一朗室山真徳石原 亨安浦寛人九大
(4) 15:30-16:00 メモリアクセスおよびリソース共有を行うカスタム命令自動生成手法 瀬戸謙修藤田昌宏東大
5月11日(木) 午後  招待講演
16:15 - 17:00
(5) 16:15-17:00 [招待講演]コンフィギュラブル・プロセッサ開発環境ASIP Meister 今井正治谷口一徹武内良典坂主圭史阪大
5月12日(金) 午前  検証・シミュレーション
09:00 - 10:30
(6) 09:00-09:30 Bottom-up Equivalence Checking for SpecC Programs Subash ShankarCity Univ. of New York)・○Masahiro FujitaUniv. of Tokyo
(7) 09:30-10:00 動作合成前後の設計記述に対する記号シミュレーションによる形式的等価性検証の検討 松本剛史小松 聡藤田昌宏東大
(8) 10:00-10:30 値独立なシミュレータカーネルを用いた3値論理シミュレータの実装 和田崇臣日比野 靖北陸先端大
5月12日(金) 午前  テスト
10:45 - 11:45
(9) 10:45-11:15 テスト生成における間接含意の効率的な生成方法 吉村正義福岡知的クラスター研)・梶原誠司九工大)・松永裕介九大
(10) 11:15-11:45 Power-Conscious Microprocessor-Based Testing of System-on-Chip Fawnizu Azmadi HussinTomokazu YonedaNAIST)・Alex OrailogluUniv. of California)・Hideo FujiwaraNAIST
5月12日(金) 午後  演算回路・ばらつきの測定
13:00 - 14:30
(11) 13:00-13:30 相関演算結果を用いた8-VSBイコライザの面積削減 河嶋和美小西悠介橋口裕介山本 優沼 昌宏神戸大
(12) 13:30-14:00 整数乗算器の消費電力と遅延について ~ Wallace Tree, Dadda Treeの比較 ~ 橘 昌良高知工科大
(13) 14:00-14:30 90nmCMOS回路における遅延および電力ばらつきの実測と解析 山口聖貴九大)・Yang Yuan西安理工大)・樽見幸祐坂本良太室山真徳石原 亨安浦寛人九大

講演時間
一般講演発表 25 分 + 質疑応答 5 分

問合先と今後の予定
VLD VLSI設計技術研究会(VLD)   [今後の予定はこちら]
問合先 松永 裕介 (九州大)
TEL 092-583-7621, FAX 092-583-1338
E--mail: matsunaga@ c.csce.kyushu-u.ac.jp 
お知らせ ◎最新情報は、VLD研究会ホームページをご覧下さい。
http://www.ieice.org/vld/index-j.html
IPSJ-SLDM システムLSI設計技術研究会(IPSJ-SLDM)   [今後の予定はこちら]
問合先  


Last modified: 2006-04-18 12:40:00


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