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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2012-11-28 09:50 |
福岡 | 九州大学百年講堂 | ビアプログラマブルロジックVPEXの配置配線ツールを用いた性能評価 ○大谷 拓・堀 遼平・上岡泰輔（立命館大）・吉川雅弥（名城大）・藤野 毅（立命館大）  VLD2012-90 DC2012-56 |
当研究室では，ビア層をカスタマイズすることで任意の論理を実現可能なビアプログラマブルロジックVPEXの開発，研究を行って... [more] | VLD2012-90 DC2012-56 pp.177-182 |
| VLD | 2012-03-06 10:35 |
大分 | ビーコンプラザ | ビアプログラマブルASICアーキテクチャVPEXの消費電力評価と面積・遅延性能評価 ○大谷 拓・堀 遼平・北森達也・上岡泰輔（立命館大）・吉川雅弥（名城大）・藤野 毅（立命館大） VLD2011-121 |
当研究室では，ビア層をカスタマイズすることで任意の論理を実現可能なビアプログラマブルアーキテクチャVPEXの開発，研究を... [more] | VLD2011-121 pp.7-12 |
| ICD | 2011-12-15 16:10 |
大阪 | 大阪大学会館 | ［ポスター講演］ビアプログラマブルロジックVPEXのソフトエラー率の検討 ○上岡泰輔・堀 遼平・北森達也（立命館大）・吉川雅弥（名城大）・藤野 毅（立命館大） ICD2011-119 |
[more] | ICD2011-119 pp.93-98 |
| VLD | 2011-03-04 15:30 |
沖縄 | 沖縄県男女共同参画センター | ビアプログラマブルASICアーキテクチャVPEX3の面積と遅延評価 ○上岡泰輔・北森達也・堀 遼平（立命館大）・吉川雅弥（名城大）・藤野 毅（立命館大） VLD2010-146 |
複合ゲート型Exclusive-ORとNOTゲートで基本論理素子(LE)を構成するビアプログラマブルASICアーキテクチ... [more] | VLD2010-146 pp.177-182 |
| VLD | 2011-03-04 15:55 |
沖縄 | 沖縄県男女共同参画センター | ビアプログラマブルデバイスVPEXにおける配線リソースと配線遅延の評価 ○北森達也・堀 遼平・上岡泰輔（立命館大）・吉川雅弥（名城大）・藤野 毅（立命館大） VLD2010-147 |
我々は，ビア層のレイアウトを変更することにより，任意のデジタル論理を実現できるビアプログラマブルストラクチャードASIC... [more] | VLD2010-147 pp.183-188 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2010-11-30 09:30 |
福岡 | 九州大学医学部百年講堂 | ビアプログラマブルストラクチャードASIC・VPEXの新アーキテクチャ提案と性能評価 ○堀 遼平・北森達也・上岡泰輔（立命館大）・吉川雅弥（名城大）・藤野 毅（立命館大） CPM2010-132 ICD2010-91 |
[more] | CPM2010-132 ICD2010-91 pp.49-54 |
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