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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
VLD 2014-03-04
16:10
沖縄 沖縄県青年会館 [記念講演]Co-simulation Framework for Streamlining Microprocessor Development on Standard ASIC Design Flow
Tomoyuki NakabayashiTomoyuki SugiyamaTakahiro SasakiMie Univ.)・Eric RotenbergNCSU)・Toshio KondoMie Univ.VLD2013-154
近年,プロセッサは計算性能を向上するためにより複雑なアーキテクチャを採用しており,最先端プロセッサの設計・試作にかかる時... [more] VLD2013-154
p.113
DC, CPSY
(併催)
2013-08-02
17:00
福岡 北九州国際会議場 FabScalar を用いた可変段数パイプライン構造を有するスーパスカラプロセッサの詳細設計
中林智之・○三好聖二佐々木敬泰近藤利夫三重大CPSY2013-27
近年,コンピュータの消費電力の増大が問題となり,プロセッサに高性能と低消費電力の両立が要求されている. 我々は,高性能と... [more] CPSY2013-27
pp.103-108
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2011-11-29
13:50
宮崎 ニューウェルシティ宮崎 可変パイプライン段数アーキテクチャへのパワーゲーティング適用による低消費エネルギー効果の評価
田中将輝佐々木敬泰中林智之大野和彦近藤利夫三重大CPSY2011-45
近年,モバイルコンピューティングの分野ではプロセッサの消費電力の増大が問題となっており,低消費エネルギーと高性能の両立が... [more] CPSY2011-45
pp.15-20
VLD 2011-03-03
09:55
沖縄 沖縄県男女共同参画センター Split-output Latchを用いたSemi-static TSPC DFFの提案と評価
中林智之佐々木敬泰大野和彦近藤利夫三重大VLD2010-125
DFFはスタンダードセル部における占有面積,消費電力が大きく,その高性能化
はチップ全体の性能に大きく貢献する.
T... [more]
VLD2010-125
pp.51-56
CPSY 2008-10-31
15:00
広島 広島市立大学 可変段数パイプラインアーキテクチャ(VSP)の更なる低消費電力化手法の提案とLSI設計
中林智之佐々木敬泰大野和彦近藤利夫三重大CPSY2008-34
近年,モバイル端末等の高性能化に伴う消費電力の増加が問題となっており,低
消費エネルギーと高性能の両立が要求されてい... [more]
CPSY2008-34
pp.29-34
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