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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| RECONF, VLD (共催) |
2024-01-29 17:00 |
神奈川 | 新川崎 創造のもり AIRBIC 会議室1～4 （ハイブリッド開催，主：現地開催，副：オンライン開催） |
テスタ測定とデータ分析を考慮した評価チップ仕様導出例の紹介 ～ ラッチベース回路とフリップフロップベース回路の比較評価向け ～ ○谷本匡亮・平賀啓三・加藤俊彦・別所和宏・清水俊雅（ソニーセミコンダクタソリューションズ）  VLD2023-90 RECONF2023-93 |
同期式論理回路では，ラッチベース回路の低電力や高速動作特性でのフリップフロップベース回路に対する優位性がしばしば議論され... [more] | VLD2023-90 RECONF2023-93 pp.59-64 |
| VLD, DC, RECONF, ICD, IPSJ-SLDM (連催) (併催) [詳細] |
2020-11-18 09:55 |
ONLINE | オンライン開催 | 高速・高空間解像度CMOSイメージセンサのためのリングアンプを用いた列並列パイプラインADC ○小嶋 隆（東京理科大）・大高俊徳，亀田裕介・浜本隆之（東京理科大） VLD2020-28 ICD2020-48 DC2020-48 RECONF2020-47 |
高時間分解能と高空間解像度を両立して撮像できるCMOSイメージセンサは工場での検査や計測等で要求される．高速な撮像にはパ... [more] | VLD2020-28 ICD2020-48 DC2020-48 RECONF2020-47 pp.101-105 |
| ICD, HWS (共催) [詳細] |
2020-10-26 09:25 |
ONLINE | オンライン開催 | ペアリングハードウェアに対するパイプラインスケジューリングを利用した電力解析攻撃 ○山﨑満文・坂本純一・松本 勉（横浜国大） HWS2020-26 ICD2020-15 |
高機能暗号の構成に用いられるペアリング計算のレイテンシを小さく抑えるために，パイプライン型剰余乗算器を搭載したハードウェ... [more] | HWS2020-26 ICD2020-15 pp.7-12 |
| RECONF | 2020-09-10 13:55 |
ONLINE | オンライン開催 | Stratix 10 FPGAクラスタにおける格子ボルツマン法のパイプライン並列化と性能評価 ○小柴篤史・上野知洋・佐野健太郎（理研） RECONF2020-20 |
我々はハイエンドFPGAであるIntel Stratix 10を用いたFPGAクラスタの研究開発および大規模計算の高速化... [more] | RECONF2020-20 pp.7-12 |
| ICTSSL, CAS (共催) |
2020-01-30 18:00 |
東京 | 機械振興会館 | 高位合成向けプログラム記述法におけるヒストグラム直列複製とその効果 ○山崎萌奈・山脇 彰（九工大） CAS2019-80 ICTSSL2019-49 |
高性能かつ省電力な組込み画像処理機器の迅速な実現には，ソフトウェアの自動ハードウェア化 (高位合成)を用いた画像処理のハ... [more] | CAS2019-80 ICTSSL2019-49 pp.85-89 |
| IPSJ-SLDM, IPSJ-ARC (共催) RECONF, VLD, CPSY (共催) (連催) [詳細] |
2020-01-23 13:55 |
神奈川 | 慶応義塾大学 日吉キャンパス 来往舎 | 5段パイプラインのRISC-Vソフトプロセッサの設計と実装 ○宮崎広夢・金森拓斗・Md Ashraful Islam・吉瀬謙二（東工大） VLD2019-73 CPSY2019-71 RECONF2019-63 |
本稿では，RISC-Vの基本命令セットであるRV32IをサポートするFPGA向けに最適化された5段パイプラインのRISC... [more] | VLD2019-73 CPSY2019-71 RECONF2019-63 pp.123-128 |
| ISEC, SITE, ICSS, EMM, HWS, BioX (共催) IPSJ-CSEC, IPSJ-SPT (共催) (連催) [詳細] |
2019-07-23 14:25 |
高知 | 高知工科大学 | パイプライン型剰余乗算器を用いたペアリング計算FPGAのサイドチャネルセキュリティ評価 ○山﨑満文・坂本純一・奥秋陽太・松本 勉（横浜国大） ISEC2019-29 SITE2019-23 BioX2019-21 HWS2019-24 ICSS2019-27 EMM2019-32 |
双線形ペアリングはadvanced cryptographyを実現する際に有用であるため，その高速ハードウェア実装のサイ... [more] | ISEC2019-29 SITE2019-23 BioX2019-21 HWS2019-24 ICSS2019-27 EMM2019-32 pp.151-156 |
| ISEC, SITE, ICSS, EMM, HWS, BioX (共催) IPSJ-CSEC, IPSJ-SPT (共催) (連催) [詳細] |
2019-07-23 14:50 |
高知 | 高知工科大学 | パイプライン型剰余乗算器を用いたペアリング暗号のFPGA実装 ～ 集約署名の場合 ～ ○奥秋陽太・坂本純一・藤本大介・松本 勉（横浜国大） ISEC2019-30 SITE2019-24 BioX2019-22 HWS2019-25 ICSS2019-28 EMM2019-33 |
サイバーフィジカルシステムやクラウドコンピューティングのセキュリティ充実のため高機能暗号への期待が高まっている．暗号化し... [more] | ISEC2019-30 SITE2019-24 BioX2019-22 HWS2019-25 ICSS2019-28 EMM2019-33 pp.157-162 |
| IN, NS (併催) |
2019-03-05 09:00 |
沖縄 | 沖縄コンベンションセンター | 核融合実験装置LHDの大容量データを用いた多地点高速転送実験 ○山中顕次郎（総研大/NII）・中西秀哉（自然科学研究機構）・小関隆久・徳永晋介・石井康友（量研機構）・阿部俊二・漆谷重雄（総研大/NII）・山本孝志・江本雅彦（自然科学研究機構） NS2018-233 |
先端科学技術分野では，国際協力で巨大な実験・観測装置を作り，得られたビックデータを各国で分析することが多い．ビックデータ... [more] | NS2018-233 pp.237-242 |
| SCE | 2019-01-23 13:30 |
東京 | 機械振興会館 | 単一磁束量子ゲートレベルパイプラインマイクロプロセッサに向けた30GHzデータパスの開発 ○長岡一起（名大）・畑中湧貴（三菱電機）・松井裕一（名大）・石田浩貴（九大）・田中雅光・佐野京佑・山下太郎（名大）・小野貴継・井上弘士（九大）・藤巻 朗（名大） SCE2018-30 |
我々はCMOSマイクロプロセッサを凌駕する高スループットを実現することを目的として、単一磁束量子（SFQ）マイクロプロセ... [more] | SCE2018-30 pp.29-34 |
| HWS, ICD (共催) |
2018-10-29 14:30 |
大阪 | 神戸大 梅田インテリジェントラボラトリ | パイプライン型剰余乗算器を用いたペアリング計算器における圧縮自乗算の高速化 ○奥秋陽太・坂本純一・吉田直樹・藤本大介・松本 勉（横浜国大） HWS2018-50 ICD2018-42 |
サイバーフィジカルシステムやクラウド活用の進展に伴い，暗号化したままデータ検索が行えるなど，従来の公開鍵暗号技術より機能... [more] | HWS2018-50 ICD2018-42 pp.19-24 |
| HWS | 2018-04-13 13:55 |
福岡 | 九州大学医学部 百年講堂 | パイプライン型剰余乗算器を用いたペアリング計算器のFPGA実装による消費エネルギー評価 長浜佑介・藤本大介・○坂本純一・松本 勉（横浜国大） HWS2018-5 |
ペアリング計算を行う専用ハードウェアのFPGA 実装に関する公表論文においては，消費エネルギーでの観点からの考察があまり... [more] | HWS2018-5 pp.23-28 |
| NS, IN (併催) |
2018-03-01 10:50 |
宮崎 | フェニックス・シーガイア・リゾート | LHD大容量データの遠隔レプリケーション ～ MMCFTPとパイプライン化レプリケーションによる145TBデータの4Gbps移送 ～ ○山中顕次郎（総研大/NII）・中西秀哉（自然科学研究機構）・小関隆久（量研機構）・阿部俊二・漆谷重雄（総研大/NII）・山本孝志・江本雅彦・中島徳嘉（自然科学研究機構） NS2017-180 |
先端科学技術分野で国際共有される大容量データは，多数の小さなファイルで構成されることが多い．小さなファイルのままファイル... [more] | NS2017-180 pp.73-78 |
| VLD, DC, IPSJ-SLDM, IPSJ-EMB (連催) CPSY, IPSJ-ARC (連催) CPM, ICD, IE (共催) RECONF (併催) [詳細] |
2017-11-07 09:25 |
熊本 | くまもと県民交流館パレア | グリッチ削減のためのパイプライン構造の最適化 ○小島拓也・安藤尚輝・奥原 颯・天野英晴（慶大） RECONF2017-41 |
CGRA(Coarse Grained Reconfigurable Array)ではエネルギー効率を高めるために複数の... [more] | RECONF2017-41 pp.25-30 |
| VLD, DC, IPSJ-SLDM, IPSJ-EMB (連催) CPSY, IPSJ-ARC (連催) CPM, ICD, IE (共催) RECONF (併催) [詳細] |
2017-11-07 10:55 |
熊本 | くまもと県民交流館パレア | MIMO-OFDM無線通信における信号分離のためのパイプライン型逆行列演算回路のアーキテクチャ検討 ○今川隆司（立命館大）・池下貴大・筒井 弘・宮永喜一（北大） VLD2017-45 DC2017-51 |
無線通信の高速化を目的としたMIMO のストリーム数やOFDM のサブキャリア数の増加に伴って，信号分離に要する計算量が... [more] | VLD2017-45 DC2017-51 pp.105-108 |
| SCE | 2017-08-09 14:35 |
愛知 | 名古屋大学(東山キャンパス) | 単一磁束量子ゲートレベルパイプラインマイクロプロセッサに向けた要素回路設計 ○畑中湧貴・松井裕一・田中雅光・佐野京佑・藤巻 朗（名大）・石田浩貴・小野貴継・井上弘士（九大） SCE2017-17 |
我々は CMOS マイクロプロセッサの性能を凌駕することを最終目的とし、高スループットな単一磁束 量子（RSFQ）マイク... [more] | SCE2017-17 pp.37-42 |
| CPSY, DC, IPSJ-ARC (連催) RECONF (併催) [詳細] |
2017-05-23 10:55 |
北海道 | 登別温泉第一滝本館 | 整数計画問題を用いたパイプライン型CGRAのボディバイアス電圧最適化 ○小島拓也・安藤尚輝・奥原 颯・Ng.Doan Anh Vu・天野英晴（慶大） RECONF2017-16 |
バッテリー駆動型のデバイスでは一定の性能を低消費電力で実現することが要求される。素粒度再構成可能アクセラレータ(CGRA... [more] | RECONF2017-16 pp.81-86 |
| CPSY, DC (共催) IPSJ-SLDM, IPSJ-EMB, IPSJ-ARC (共催) (連催) [詳細] |
2017-03-09 16:10 |
沖縄 | 具志川農村環境改善センター | パイプライン段数とボディバイアス電圧制御によるパイプライン型CGRAの電力削減手法の検討 ○小島拓也・安藤尚輝・松下悠亮・奥原 颯・天野英晴（慶大） CPSY2016-140 DC2016-86 |
IoT時代においてウェアラブルデバイスなどのバッテリー駆動の高機能で小型なデバイスが求められている。こうしたデバイスは一... [more] | CPSY2016-140 DC2016-86 pp.51-56 |
| ICD, CPSY (共催) |
2016-12-15 11:20 |
東京 | 東京工業大学 | 三次元積層チップにおける可変パイプライン型超低電力再構成可能アクセラレータの実装 ○安藤尚輝・増山滉一郎・天野英晴（慶大） ICD2016-54 CPSY2016-60 |
ビルディングブロック型計算システムは、小規模なチッフ&#... [more] | ICD2016-54 CPSY2016-60 pp.19-24 |
| ICD, CPSY (共催) |
2016-12-15 15:30 |
東京 | 東京工業大学 | ［ポスター講演］パイプライン型ADCにおけるゲインステージ用オペアンプの最適化に関する研究 ○藤浪大輔・佐々木昌浩（芝浦工大） ICD2016-83 CPSY2016-89 |
パイプライン型ADC(Analog to Digital Converter)は，ステージを縦続に接続した構成をしている... [more] | ICD2016-83 CPSY2016-89 p.93 |
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