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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| HWS, VLD (共催) |
2023-03-03 15:45 |
沖縄 | 沖縄県青年会館 （ハイブリッド開催，主：現地開催，副：オンライン開催） |
RG-DTM型アービターPUFのFPGA実装と固有ID生成特性改善の検討 ○堺 美華・大山達哉・吉田康太（立命館大）・堀 洋平・片下敏宏（産総研）・白畑正芳・藤野 毅（立命館大）  VLD2022-111 HWS2022-82 |
FPGA上で固有のIDを生成する手段としてPUF実装の検討を行っている．ユニーク性の高い固有IDを生成できるアービターP... [more] | VLD2022-111 HWS2022-82 pp.209-214 |
| IEE-CMN, ITE-BCT (共催) OFT, OCS (併催) (連催) ※学会内は併催 [詳細] |
2021-11-19 13:25 |
ONLINE | オンライン開催 | 高分解能オフセット周波数補償アルゴリズムを用いた実時間4モード多重16QAM伝送実験 ○別府翔平（KDDI総合研究所）・菊田将弘（NECプラットフォームズ）・五十嵐浩司（阪大）・向 啓志・鴫原正博（NECプラットフォームズ）・相馬大樹・高橋英憲・吉兼 昇・釣谷剛宏（KDDI総合研究所） OCS2021-31 |
モード多重伝送方式は，光ファイバ中の異なる伝搬モードに異なる信号を多重伝送し，受信側において多入力多出力（multipl... [more] | OCS2021-31 pp.15-20 |
| IPSJ-SLDM, IPSJ-ARC (共催) RECONF, VLD, CPSY (共催) (連催) [詳細] |
2020-01-23 14:45 |
神奈川 | 慶応義塾大学 日吉キャンパス 来往舎 | 簡易ディジタルスパイキングニューロンとそのFPGA実装に関する一考察 ○米田友洋（NII） VLD2019-75 CPSY2019-73 RECONF2019-65 |
必要リソース量，消費電力の少ないFPGA実現を得ることを目的に，簡易化したディジタルスパイキングニューロンを考案した．学... [more] | VLD2019-75 CPSY2019-73 RECONF2019-65 pp.135-140 |
| ISEC, SITE, ICSS, EMM, HWS, BioX (共催) IPSJ-CSEC, IPSJ-SPT (共催) (連催) [詳細] |
2019-07-23 14:50 |
高知 | 高知工科大学 | パイプライン型剰余乗算器を用いたペアリング暗号のFPGA実装 ～ 集約署名の場合 ～ ○奥秋陽太・坂本純一・藤本大介・松本 勉（横浜国大） ISEC2019-30 SITE2019-24 BioX2019-22 HWS2019-25 ICSS2019-28 EMM2019-33 |
サイバーフィジカルシステムやクラウドコンピューティングのセキュリティ充実のため高機能暗号への期待が高まっている．暗号化し... [more] | ISEC2019-30 SITE2019-24 BioX2019-22 HWS2019-25 ICSS2019-28 EMM2019-33 pp.157-162 |
| HWS, ICD (共催) |
2018-10-29 14:30 |
大阪 | 神戸大 梅田インテリジェントラボラトリ | パイプライン型剰余乗算器を用いたペアリング計算器における圧縮自乗算の高速化 ○奥秋陽太・坂本純一・吉田直樹・藤本大介・松本 勉（横浜国大） HWS2018-50 ICD2018-42 |
サイバーフィジカルシステムやクラウド活用の進展に伴い，暗号化したままデータ検索が行えるなど，従来の公開鍵暗号技術より機能... [more] | HWS2018-50 ICD2018-42 pp.19-24 |
| HWS | 2018-04-13 13:55 |
福岡 | 九州大学医学部 百年講堂 | パイプライン型剰余乗算器を用いたペアリング計算器のFPGA実装による消費エネルギー評価 長浜佑介・藤本大介・○坂本純一・松本 勉（横浜国大） HWS2018-5 |
ペアリング計算を行う専用ハードウェアのFPGA 実装に関する公表論文においては，消費エネルギーでの観点からの考察があまり... [more] | HWS2018-5 pp.23-28 |
| RCS, RCC, ASN, NS, SR (併催) |
2016-07-21 13:45 |
愛知 | 名古屋工業大学 | PAPRを低減するトレリスシェイピングを用いたOFDMシステムのFPGA実装 ○宋 家佳・落合秀樹（横浜国大） RCS2016-120 |
トレリスシェイピング（TS: Trellis Shaping）は畳み込み符号の構造を利用した高い柔軟性を有する信号制御手... [more] | RCS2016-120 pp.133-138 |
| RCS | 2015-06-25 16:20 |
北海道 | 北海道大学 | 双方向MIMOフェージングエミュレータの構成提案とFPGAによる回路実装 小谷里佳子・○唐沢好男（電通大） RCS2015-78 |
MIMO端末の性能評価のためのマルチパス環境を簡易にエミュレーションする構成として提案している「アンテナブランチ制御法」... [more] | RCS2015-78 pp.191-196 |
| RECONF | 2015-06-19 13:20 |
京都 | 京都大学 | 大腸内視鏡診断支援のための複数サイズの階層的検出ウィンドウを用いたタイプ識別ハードウェア ○岡本拓巳・小出哲士・清水達也・杉 幸樹・Anh-Tuan Hoang・佐藤 光・玉木 徹・Bisser Raytchev・金田和文（広島大）・吉田成人・三重野 寛（広島鉄道病院）・田中信治（広島大） RECONF2015-5 |
近年の大腸ガン患者数の増加に伴い，病状を定量的に評価し医師の診断を支援する Computer-Aided Diagnos... [more] | RECONF2015-5 pp.23-28 |
| RECONF | 2015-06-19 13:45 |
京都 | 京都大学 | Bag-of-Featuresに基づくVisual Word特徴量変換ハードウェアに関する考察 ○杉 幸樹・小出哲士・清水達也・岡本拓巳・Anh-Tuan Hoang・佐藤 光・玉木 徹・Bisser Raytchev・金田和文（広島大）・吉田成人・三重野 寛（JR西日本広島鉄道病院）・田中信治（広島大） RECONF2015-6 |
近年，大腸ガンの診断において効果的に医師の診断を支援するCAD（Computer-Aided Diagnosis）システ... [more] | RECONF2015-6 pp.29-34 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2014-11-26 16:40 |
大分 | ビーコンプラザ（別府国際コンベンションセンター） | 運転者支援のためのリアルタイム道路標識検出処理のFPGA実装 ○山本真晴・Anh-Tuan Hoang・小出哲士（広島大） VLD2014-76 DC2014-30 |
本研究では，先進運転支援システム（ADAS）のためのコンパクトなハードウェアに実装可能で，リアルタイム（15 ~ 30 ... [more] | VLD2014-76 DC2014-30 pp.27-32 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2014-11-26 17:30 |
大分 | ビーコンプラザ（別府国際コンベンションセンター） | 大腸内視鏡診断支援のためのSupport Vector Machineを用いたタイプ識別ハードウェアの設計 ○岡本拓巳・小出哲士・Anh-Tuan Hoang・杉 幸樹・清水達也・玉木 徹・Bisser Raytchev・金田和文・小南陽子・吉田成人・田中信治（広島大） VLD2014-78 DC2014-32 |
近年の大腸ガン患者数の増加に伴い，病状を定量的に評価し医師の診断を支援するComputer-Aided Diagnosi... [more] | VLD2014-78 DC2014-32 pp.39-44 |
| CPSY | 2014-11-13 12:30 |
広島 | 広島大学 | 標識の歪みや見え方にロバストなハードウェア向け速度標識検出アルゴリズム ○山本真晴・Anh-Tuan Hoang・小出哲士（広島大） CPSY2014-54 |
本研究のでは，先進運転支援システム（ADAS）のためのコンパクトなハードウェアに実装可能で，リアルタイム（15 ~ 30... [more] | CPSY2014-54 pp.1-6 |
| EMM, ISEC, SITE, ICSS (共催) IPSJ-CSEC, IPSJ-SPT (併催) (連催) [詳細] |
2013-07-18 14:50 |
北海道 | 札幌コンベンションセンター | Arbiter PUFのFPGA実装における評価手法と脆弱性 ○町田卓謙・中曽根俊貴・崎山一男（電通大） ISEC2013-18 SITE2013-13 ICSS2013-23 EMM2013-20 |
Physical Unclonable Function~(PUF)のハードウェア実装として回路の信号遅延差を利用するA... [more] | ISEC2013-18 SITE2013-13 ICSS2013-23 EMM2013-20 pp.53-58 |
| ASN, RCS, NS, SR (併催) |
2013-07-19 09:25 |
静岡 | アクトシティ浜松 | 簡易型MIMOフェージングエミュレータの開発とその応用 中田克弘・小谷里佳子・○唐沢好男（電通大） RCS2013-115 |
MIMO 通信端末を実際の電波環境で評価するためには，被測定端末の周辺にフェージング環境を形成するOTA（Over-th... [more] | RCS2013-115 pp.203-208 |
| SR | 2012-05-24 13:00 |
神奈川 | 慶応大（日吉キャンパス） | ［技術展示］簡易型広帯域MIMO-OTAシステム信号処理部のFPGA実装と評価 ○中田克弘・唐沢好男（電通大） SR2012-5 |
MIMO通信端末を実際の電波環境で評価するためには， 測定端末の周辺にフェージング環境を形成するOTA（Over-th... [more] |
SR2012-5 pp.31-36 |
| SR | 2011-07-28 15:05 |
神奈川 | YRP | ［技術展示］簡易形広帯域MIMO-OTAシステム信号処理部のFPGA実装 ○唐沢好男・パシシンギ サハルル・グナワン ヤンネス・中田克弘（電通大） SR2011-26 |
MIMO通信端末を模擬電波環境で評価したい場合には、OTA (Over-the-Air)状態での測定評価環境が必要になる... [more] | SR2011-26 pp.55-60 |
| RECONF | 2010-05-14 13:15 |
長崎 | 長崎温泉 やすらぎ伊王島 (長崎市伊王島町) | An Efficient Implementation of Exhaustive Verification of the Collatz Conjecture using DSP48E blocks of Xilinx Virtex-5 FPGAs ○Yasuaki Ito・Koji Nakano（Hiroshima Univ.） RECONF2010-15 |
任意の正の数に対して，偶数のときその数を$2$で割り，奇数のとき$3$倍して$1$を加えるという操作を考える．コラッツ予... [more] | RECONF2010-15 pp.81-86 |
| VLD, CPSY, RECONF (共催) IPSJ-SLDM (連催) [詳細] |
2010-01-26 13:30 |
神奈川 | 慶應義塾大学日吉キャンパス | 3次元DCTを効率的に処理するアレイプロセッサのFPGA実装 ○生垣佑樹・五十嵐裕之・宮崎敏明・Stanislav G. Sedukhin（会津大） VLD2009-76 CPSY2009-58 RECONF2009-61 |
従来のアレイプロセッサでは3次元DCTを行うためにメモリ上に格納した係数と入力データに何度もランダムにアクセスする必要が... [more] | VLD2009-76 CPSY2009-58 RECONF2009-61 pp.41-46 |
| RECONF | 2009-09-18 15:25 |
栃木 | 宇都宮大学 | An FPGA-based Architecture for Verifying Collatz Conjecture ○Yasuaki Ito・Koji Nakano（Hiroshima Univ.） RECONF2009-40 |
任意の正の数に対して，偶数のときその数を$2$で割り，奇数のとき$3$倍して$1$を加えるという操作を考える．コラッツ予... [more] | RECONF2009-40 pp.125-130 |
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