| 講演抄録／キーワード |
| 講演名 |
2006-09-15 11:45
A Parametric Study of Packet-Switched FPGA Overlay Networks
○Daihan Wang・Hiroki Matsutani・Masato Yoshimi（Keio Univ.）・Michihiro Koibuchi（NII）・Hideharu Amano（Keio Univ.） |
| 抄録 |
（和） |
(まだ登録されていません) |
| （英） |
The constantly upgrading gate capacity of FPGAs
enables us to implement a complex system on a chip.
A packet-switched network presents to share
network resources by multiple connections, so as to
make the best use of link bandwidth.
This study investigates the suitable
overlay interconnects on FPGAs in terms of the amount of hardware, and
throughput based on a parametric approach.
Because the number of ports on a router sometimes dominates the amount of hardware
for router, and its throughput performance, it has been chosen as a
parameter. Based on a typical implementation of NoC router,
various networks have been generalized and evaluated, in the case of both 16 hosts
and 36 hosts.
Evaluation results show that for small systems with 16 hosts or less,
a full-crossbar switch is advantageous from the viewpoint of both
throughput performance and hardware cost.
On the other hand, when systems become large,
the partitioned networks are efficient from the viewpoint of hardware cost.
When the performance requirement is not so critical, we should
select partitioned topology which requires minimum hardware and use some
localization methods to improve the performance. |
| キーワード |
（和） |
/ / / / / / / |
| （英） |
FPGA / Networks-on-chip / Router / Node degree / Simulation / / / |
| 文献情報 |
信学技報, vol. 106, no. 247, RECONF2006-32, pp. 31-36, 2006年9月. |
| 資料番号 |
RECONF2006-32 |
| 発行日 |
2006-09-08 (RECONF) |
| ISSN |
Print edition: ISSN 0913-5685 |
| PDFダウンロード |
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| 研究会情報 |
| 研究会 |
RECONF |
| 開催期間 |
2006-09-14 - 2006-09-15 |
| 開催地（和） |
熊本大学 工学部百周年記念館 |
| 開催地（英） |
Kumamoto Univ. |
| テーマ（和） |
リコンフィギャラブルシステム，一般 |
| テーマ（英） |
Reconfigurable Systems, etc. |
| 講演論文情報の詳細 |
| 申込み研究会 |
RECONF |
| 会議コード |
2006-09-RECONF |
| 本文の言語 |
英語 |
| タイトル（和） |
|
| サブタイトル（和） |
|
| タイトル（英） |
A Parametric Study of Packet-Switched FPGA Overlay Networks |
| サブタイトル（英） |
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| キーワード(1)（和/英） |
/ FPGA |
| キーワード(2)（和/英） |
/ Networks-on-chip |
| キーワード(3)（和/英） |
/ Router |
| キーワード(4)（和/英） |
/ Node degree |
| キーワード(5)（和/英） |
/ Simulation |
| キーワード(6)（和/英） |
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| キーワード(7)（和/英） |
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| キーワード(8)（和/英） |
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| 第1著者 氏名（和/英/ヨミ） |
王 代涵 / Daihan Wang / ワン ダイハン |
| 第1著者 所属（和/英） |
慶応大学 (略称： 慶大)
Keio University (略称： Keio Univ.) |
| 第2著者 氏名（和/英/ヨミ） |
松谷 宏紀 / Hiroki Matsutani / マツタニ ヒロキ |
| 第2著者 所属（和/英） |
慶応大学 (略称： 慶大)
Keio University (略称： Keio Univ.) |
| 第3著者 氏名（和/英/ヨミ） |
吉見 真聡 / Masato Yoshimi / ヨシミ マサト |
| 第3著者 所属（和/英） |
慶応大学 (略称： 慶大)
Keio University (略称： Keio Univ.) |
| 第4著者 氏名（和/英/ヨミ） |
鯉渕 道紘 / Michihiro Koibuchi / コイブチ ミチヒロ |
| 第4著者 所属（和/英） |
国立情報学研究所 (略称： NII)
National Institute of Informatics (略称： NII) |
| 第5著者 氏名（和/英/ヨミ） |
天野 英晴 / Hideharu Amano / アマノ ヒデハル |
| 第5著者 所属（和/英） |
慶応大学 (略称： 慶大)
Keio University (略称： Keio Univ.) |
| 第6著者 氏名（和/英/ヨミ） |
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| 講演者 |
第1著者 |
| 発表日時 |
2006-09-15 11:45:00 |
| 発表時間 |
30分 |
| 申込先研究会 |
RECONF |
| 資料番号 |
RECONF2006-32 |
| 巻番号（vol） |
vol.106 |
| 号番号（no） |
no.247 |
| ページ範囲 |
pp.31-36 |
| ページ数 |
6 |
| 発行日 |
2006-09-08 (RECONF) |
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