| 講演抄録／キーワード |
| 講演名 |
2006-10-27 13:10
［招待講演］大域クロックを用いた一般同期回路 ～ 設計方法論，それらを支えるツール群，今後の展望 ～
○高橋篤司（東工大） |
| 抄録 |
（和） |
現在，デジタル回路の多くは大域的クロックを用い同期をとる同期回路として実現されているが，回路の微細化，高速化にともないクロック回路設計の困難さが増大しており，大域的クロックを用いる方式の限界も言われている．しかし，現在の同期方式は信号回路設計とクロック回路設計の分離を容易にするため，すべての信号間の同期を同時にとる完全同期方式が追求されている．そのため，大域的クロックを用いる方式でもより一般的な同期方式を採用することで，従来の完全同期方式よりも高性能な回路が実現できることが期待される．しかし，設計空間が爆発的に増大するため効率的な設計方法論を確立しなければならない．本稿では，一般同期方式の原理を示し，現在までに開発された一般同期方式設計のためのツールや現在検討中の設計方法論を紹介するとともに，将来の同期回路について考える． |
| （英） |
In current VLSI design, most digital circuits are synthesized as synchronous circuits which are synchronized by global clock. While, it is often said that the limitation of the current design methodology which uses global clock is approaching due to the difficulty in clock circuit synthesis caused by the rapid increase of interconnect delay. However, in current global clock based synchronous circuit design, complete-synchronization in which every data is synchronized simultaneously is pursued to separate the signal circuit design and the clock circuit design easily. Therefore, it is expected that high-performance circuits are obtained by adopting generalized synchronization framework. However, an efficient design methodology should be established to handle huge design space. In this paper, the principle of generalized synchronization, tools developed for generalized synchronous circuit design, developing design methodology,
and future synchronous circuits are discussed. |
| キーワード |
（和） |
一般同期回路 / クロックスケジュール / クロック木 / 回路合成 / 消費電力 / / / |
| （英） |
General synchronous circuits / clock schedule / clock tree / circuit synthesis / power consumption / / / |
| 文献情報 |
信学技報, vol. 106, no. 317, ICD2006-136, pp. 55-60, 2006年10月. |
| 資料番号 |
ICD2006-136 |
| 発行日 |
2006-10-20 (SIP, ICD, IE) |
| ISSN |
Print edition: ISSN 0913-5685 |
| PDFダウンロード |
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| 研究会情報 |
| 研究会 |
ICD SIP IE IPSJ-SLDM |
| 開催期間 |
2006-10-26 - 2006-10-27 |
| 開催地（和） |
宮城県・作並温泉・一の坊 |
| 開催地（英） |
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| テーマ（和） |
システムLSIの応用と要素技術、専用プロセッサ、プロセッサ、DSP、画像処理技術、及び一般<オーガナイザ：亀山 充隆（東北大学）> |
| テーマ（英） |
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| 講演論文情報の詳細 |
| 申込み研究会 |
ICD |
| 会議コード |
2006-10-ICD-SIP-IE-IPSJ-SLDM |
| 本文の言語 |
日本語 |
| タイトル（和） |
大域クロックを用いた一般同期回路 |
| サブタイトル（和） |
設計方法論，それらを支えるツール群，今後の展望 |
| タイトル（英） |
General synchronous circuits using global clock |
| サブタイトル（英） |
design methodologies, tools, and prospects |
| キーワード(1)（和/英） |
一般同期回路 / General synchronous circuits |
| キーワード(2)（和/英） |
クロックスケジュール / clock schedule |
| キーワード(3)（和/英） |
クロック木 / clock tree |
| キーワード(4)（和/英） |
回路合成 / circuit synthesis |
| キーワード(5)（和/英） |
消費電力 / power consumption |
| キーワード(6)（和/英） |
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| キーワード(7)（和/英） |
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| キーワード(8)（和/英） |
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| 第1著者 氏名（和/英/ヨミ） |
高橋 篤司 / Atsushi Takahashi / タカハシ アツシ |
| 第1著者 所属（和/英） |
東京工業大学 (略称： 東工大)
Tokyo Institute of Technology (略称： Tokyo Inst. of Tech.) |
| 第2著者 氏名（和/英/ヨミ） |
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| 講演者 |
第1著者 |
| 発表日時 |
2006-10-27 13:10:00 |
| 発表時間 |
45分 |
| 申込先研究会 |
ICD |
| 資料番号 |
SIP2006-110, ICD2006-136, IE2006-88 |
| 巻番号（vol） |
vol.106 |
| 号番号（no） |
no.315(SIP), no.317(ICD), no.319(IE) |
| ページ範囲 |
pp.55-60 |
| ページ数 |
6 |
| 発行日 |
2006-10-20 (SIP, ICD, IE) |
|