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| 講演抄録／キーワード | ||
| 講演名 | 2008-10-10 09:00 ［ポスター講演］シフト直交実数有限長系列を用いた被積分符号のためのマッチトフィルタの構成 ○山形裕紀・松元隆博・松藤信哉（山口大）  WBS2008-38 |
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| 抄録 | （和） | 本論文では，シフトの両端を除いて完全に直交するシフト直交実数有限長系列を用いた被積分符号のためのマッチトフィルタ(MF)の小規模な構成法を提案している．この構成法によればMFの乗算器数，加算器数を系列長をMとしたとき，O(M)からO(log M)に減少できる．その有効性を示すため40万ゲート相当の回路を実装出来るFPGAで試作し，長さ129の場合，従来の構成法に比べ，約47%の回路規模で実現できることを示した． |
| （英） | In this paper, we proposed the compact construction of a matched filter for integrand code, which do not require the high-rate clock pulse in two-valued PWM code, using a real-valued shift-orthogonal finite-length sequence, which has a sharp apreriodic autocorrelation function with zero sidelobes except at left and right shift-ends. This matched filters is implemented on a field programmable gate array (FPGA) corresponding to 400,000 gates. A proposed matched filter of length 129 can be constructed by the circuit scale of about 47% compared with conventional filter. |
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| キーワード | （和） | 有限長系列 / 実数系列 / 被積分符号 / マッチトフィルタ / FPGA / / / |
| （英） | finite length sequence / real-valued sequence / integrand code / matched filter / field programmable gate array / / / | |
| 文献情報 | 信学技報, vol. 108, no. 231, WBS2008-38, pp. 51-54, 2008年10月. | |
| 資料番号 | WBS2008-38 | |
| 発行日 | 2008-10-02 (WBS) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | WBS2008-38 |
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| 研究会情報 | |
| 研究会 | WBS |
| 開催期間 | 2008-10-09 - 2008-10-10 |
| 開催地（和） | 山口大学（宇部） |
| 開催地（英） | Yamaguchi Univ. |
| テーマ（和） | 一般 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | WBS |
| 会議コード | 2008-10-WBS |
| 本文の言語 | 日本語 |
| タイトル（和） | シフト直交実数有限長系列を用いた被積分符号のためのマッチトフィルタの構成 |
| サブタイトル（和） | |
| タイトル（英） | Construction of a Matched Filter for Integrand Code Using a Real-Valued Shift-Orthogonal Finite-Length Sequence |
| サブタイトル（英） | |
| キーワード(1)（和/英） | 有限長系列 / finite length sequence |
| キーワード(2)（和/英） | 実数系列 / real-valued sequence |
| キーワード(3)（和/英） | 被積分符号 / integrand code |
| キーワード(4)（和/英） | マッチトフィルタ / matched filter |
| キーワード(5)（和/英） | FPGA / field programmable gate array |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 山形 裕紀 / Yuki Yamagata / ヤマガタ ユウキ |
| 第1著者 所属（和/英） | 山口大学 (略称： 山口大) Yamaguchi University (略称： Yamaguchi Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 松元 隆博 / Takahiro Matsumoto / マツモト タカヒロ |
| 第2著者 所属（和/英） | 山口大学 (略称： 山口大) Yamaguchi University (略称： Yamaguchi Univ.) |
| 第3著者 氏名（和/英/ヨミ） | 松藤 信哉 / Shinya Matsufuji / |
| 第3著者 所属（和/英） | 山口大学 (略称： 山口大) Yamaguchi University (略称： Yamaguchi Univ.) |
| 講演者 | 第1著者 |
| 発表日時 | 2008-10-10 09:00:00 |
| 発表時間 | 105分 |
| 申込先研究会 | WBS |
| 資料番号 | WBS2008-38 |
| 巻番号（vol） | vol.108 |
| 号番号（no） | no.231 |
| ページ範囲 | pp.51-54 |
| ページ数 | 4 |
| 発行日 | 2008-10-02 (WBS) |
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