講演抄録/キーワード |
講演名 |
2009-06-12 10:35
4x4 MIMO-OFDM受信機における動的再構成可能なMMSE検出器のLSI設計 ○池内博一・吉澤真吾・宮永喜一(北大) SIS2009-14 |
抄録 |
(和) |
本報告では4x4MIMO-OFDM受信機における動的再構成可能なMMSE検出器のVLSIアーキテクチャを提案する.MIMO-OFDM方式ではMIMO復号においてサブキャリア毎の逆行列計算を実時間処理で行う必要があるため,専用回路による演算処理の高速化と同時に回路規模の縮小化が要求される.提案手法では,ストラッセン方式行列乗算および逆行列計算において動的再構成アーキテクチャを導入し,MIMO-OFDM受信機MMSE検出器での許容遅延内で演算回路を最適化する.これにより提案法は従来法よりも大幅な回路規模および消費電力の削減を達成している.MMSE検出回路をCMOS 90 nmプロセス上に実装したときの処理遅延,回路面積,消費電力について従来法と比較評価した. |
(英) |
This report presents a VLSI architecture of dynamic reconfigurable MMSE detection in a 4x4 MIMO-OFDM receiver. MIMO-OFDM imposes requirement of fast computing on the matrix inversion and small circuit area because of strict timing in frame structure and subcarrier-by-subcarrier basis processing. We propose a technique to optimize arithmetic units in the allowed time of pipelined MMSE detector by adopting a dynamic reconfigurable architecture to compute Strassen's algorithms of matrix inversion and multiplication. The proposed technique achieves large reduction of circuit area and power consumption. The designed circuit has been implemented to a 90-nm CMOS process and evaluated in processing latency, circuit area and power consumption. |
キーワード |
(和) |
MIMO-OFDM / MIMOデコーダ / MMSE検出 / 動的再構成可能 / VLSIアーキテクチャ / / / |
(英) |
MIMO-OFDM / MIMO Decoder / MMSE Detection / Dynamic Reconfigurable / VLSI Architecture / / / |
文献情報 |
信学技報, vol. 109, no. 78, SIS2009-14, pp. 79-84, 2009年6月. |
資料番号 |
SIS2009-14 |
発行日 |
2009-06-04 (SIS) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
PDFダウンロード |
SIS2009-14 |