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講演抄録/キーワード
講演名
2009-06-24 16:45
Design and Simulation of Self-Aligned Vertical Island Single Electron Transistor (VI-SET) with Electrical Tunneling Barrier.
○
Joung-eob Lee
・
Kwon-Chil Kang
・
Jung-Han Lee
・
Byung-Gook Park
(
Seoul National Univ.
)
ED2009-65 SDM2009-60
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ED2009-65
SDM2009-60
抄録
(和)
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キーワード
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文献情報
信学技報, vol. 109, no. 98, SDM2009-60, pp. 67-70, 2009年6月.
資料番号
SDM2009-60
発行日
2009-06-17 (ED, SDM)
ISSN
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
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ED2009-65 SDM2009-60
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ED2009-65
SDM2009-60
研究会情報
研究会
SDM ED
開催期間
2009-06-24 - 2009-06-26
開催地(和)
海雲台グランドホテル(釜山、韓国)
開催地(英)
Haeundae Grand Hotel, Busan, Korea
テーマ(和)
第17回先端半導体デバイスの基礎と応用に関するアジア・太平洋ワークショップ(AWAD2009)
テーマ(英)
2009 Asia-Pacific Workshop on Fundamentals and Applications of Advanced Semiconductor Devices
講演論文情報の詳細
申込み研究会
SDM
会議コード
2009-06-SDM-ED
本文の言語
英語
タイトル(和)
サブタイトル(和)
タイトル(英)
Design and Simulation of Self-Aligned Vertical Island Single Electron Transistor (VI-SET) with Electrical Tunneling Barrier.
サブタイトル(英)
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第1著者 氏名(和/英/ヨミ)
Joung-eob Lee
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第1著者 所属(和/英)
Seoul National University
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Seoul National Univ.
)
Seoul National University
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Seoul National Univ.
)
第2著者 氏名(和/英/ヨミ)
Kwon-Chil Kang
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Kwon-Chil Kang
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第2著者 所属(和/英)
Seoul National University
(略称:
Seoul National Univ.
)
Seoul National University
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Seoul National Univ.
)
第3著者 氏名(和/英/ヨミ)
Jung-Han Lee
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第3著者 所属(和/英)
Seoul National University
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Seoul National Univ.
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Seoul National University
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Seoul National Univ.
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第4著者 氏名(和/英/ヨミ)
Byung-Gook Park
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Byung-Gook Park
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第4著者 所属(和/英)
Seoul National University
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Seoul National Univ.
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Seoul National University
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Seoul National Univ.
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第5著者 氏名(和/英/ヨミ)
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第8著者 氏名(和/英/ヨミ)
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第9著者 氏名(和/英/ヨミ)
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第10著者 氏名(和/英/ヨミ)
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第12著者 氏名(和/英/ヨミ)
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講演者
第1著者
発表日時
2009-06-24 16:45:00
発表時間
15分
申込先研究会
SDM
資料番号
ED2009-65, SDM2009-60
巻番号(vol)
vol.109
号番号(no)
no.97(ED), no.98(SDM)
ページ範囲
pp.67-70
ページ数
4
発行日
2009-06-17 (ED, SDM)
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