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講演抄録/キーワード
講演名 2010-07-22 14:05
10 kA/cm2 Nb Processを用いた SFQ浮動小数点乗算器の50 GHzでの動作評価
島村泰浩貝沼世樹宮岡史滋山梨裕希吉川信行横浜国大)・藤巻 朗高木一義名大)・高木直史京大SCE2010-22
抄録 (和) SFQ回路はSFQパルスと呼ばれるピコ秒幅のインパルス状の微小電圧パルスを信号として回路中を伝搬させるため、数十GHzの高速動作や半導体に比べて消費電力が2, 3桁低いといった特徴をもっている。現在我々はSFQ回路の特徴を生かした新しいプロセッサ・アーキテクチャとして再構成可能な大規模データパス(Large Scale Reconfigurable Data Path: LSRDP)を開発している。LSRDPは多数の浮動小数点演算器(FPU)とFPUを結ぶ再構成可能なネットワークで構成されており、演算器の出力が別の演算器に直接入力される。そのため、メモリアクセス回数を減少させることができ、システム性能を制限するメモリバンド幅の制約を低減できる。
これまでにFPUの一つである半精度浮動小数点乗算器(FPM)がISTEC 2.5 kA/cm2 Nbスタンダードプロセスで設計され、最高動作周波数31 GHzでの動作が確認されている。本報告では新たに開発されたISTEC 10 kA/cm2 Nbアドバンスドプロセス(ADP)を用いたFPMの設計と高速での動作評価結果について述べる。 
(英) We have been developing a large-scale reconfigurable data-path (LSRDP) using single-flux-quantum (SFQ) circuit to realize high-end computer systems. The LSRDP is composed of a large number of floating-point units (FPUs) and reconfigurable routing network switches. Because the data are directly transferred between FPUs without memory accesses in the LSRDP, the memory access rate can be ameliorated. A floating-point multiplier (FPM) is one of the main circuit components of the LSRDP. In the previous study, the half-precision FPM was designed using the ISTEC 2.5 kA/cm2 Nb standard process and its complete operation was demonstrated at 31 GHz. Recently, to make further large SFQ circuits with enhanced performance, the ISTEC 10 kA/cm2 Nb advanced process (ADP 2.1) has been developed. In this study, we have designed and implemented the 4-bit bit-serial FPM using the ADP 2.1 process. Their high-speed operations were examined by on-chip high-speed tests.
キーワード (和) SFQ回路 / Nbプロセス / 浮動小数点演算器 / 浮動小数点乗算器 / 再構成可能なデータパス / / /  
(英) SFQ circuit / Nb process / Floating-point multiplier / Reconfigurable data-path / / / /  
文献情報 信学技報, vol. 110, no. 139, SCE2010-22, pp. 47-52, 2010年7月.
資料番号 SCE2010-22 
発行日 2010-07-15 (SCE) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード SCE2010-22

研究会情報
研究会 SCE  
開催期間 2010-07-22 - 2010-07-22 
開催地(和) 機械振興会館 
開催地(英) Kikai-Shinko-Kaikan Bldg. 
テーマ(和) 信号処理基盤技術及びその応用、一般 
テーマ(英) Signal processing technologies and their applications, etc. 
講演論文情報の詳細
申込み研究会 SCE 
会議コード 2010-07-SCE 
本文の言語 日本語 
タイトル(和) 10 kA/cm2 Nb Processを用いた SFQ浮動小数点乗算器の50 GHzでの動作評価 
サブタイトル(和)  
タイトル(英) 50 GHz Tests of SFQ Floating-Point Multipliers Using 10 kA/cm2 Nb Advanced Process 
サブタイトル(英)  
キーワード(1)(和/英) SFQ回路 / SFQ circuit  
キーワード(2)(和/英) Nbプロセス / Nb process  
キーワード(3)(和/英) 浮動小数点演算器 / Floating-point multiplier  
キーワード(4)(和/英) 浮動小数点乗算器 / Reconfigurable data-path  
キーワード(5)(和/英) 再構成可能なデータパス /  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 島村 泰浩 / Yasuhiro Shimamura / シマムラ ヤスヒロ
第1著者 所属(和/英) 横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: Yokohama National Univ.)
第2著者 氏名(和/英/ヨミ) 貝沼 世樹 / Toshiki Kainuma / カイヌマ トシキ
第2著者 所属(和/英) 横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: Yokohama National Univ.)
第3著者 氏名(和/英/ヨミ) 宮岡 史滋 / Fumishige Miyaoka / ミヤオカ フミシゲ
第3著者 所属(和/英) 横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: Yokohama National Univ.)
第4著者 氏名(和/英/ヨミ) 山梨 裕希 / Yuki Yamanashi / ヤマナシ ユウキ
第4著者 所属(和/英) 横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: Yokohama National Univ.)
第5著者 氏名(和/英/ヨミ) 吉川 信行 / Nobuyuki Yoshikawa / ヨシカワ ノブユキ
第5著者 所属(和/英) 横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: Yokohama National Univ.)
第6著者 氏名(和/英/ヨミ) 藤巻 朗 / Akira Fujimaki / フジマキ アキラ
第6著者 所属(和/英) 名古屋大学 (略称: 名大)
Nagoya University (略称: Nagoya Univ.)
第7著者 氏名(和/英/ヨミ) 高木 一義 / Kazuyoshi Takagi / タカギ カズヨシ
第7著者 所属(和/英) 名古屋大学 (略称: 名大)
Nagoya University (略称: Nagoya Univ.)
第8著者 氏名(和/英/ヨミ) 高木 直史 / Naofumi Takagi / タカギ ナオフミ
第8著者 所属(和/英) 京都大学 (略称: 京大)
Kyoto University (略称: Kyoto Univ.)
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講演者 第1著者 
発表日時 2010-07-22 14:05:00 
発表時間 25分 
申込先研究会 SCE 
資料番号 SCE2010-22 
巻番号(vol) vol.110 
号番号(no) no.139 
ページ範囲 pp.47-52 
ページ数
発行日 2010-07-15 (SCE) 


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