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講演抄録/キーワード
講演名 2010-12-16 15:10
[ポスター講演]アレイ型アクセラレータにおける演算器間ネットワークの設計
大上 俊岩上拓矢吉村和浩中田 尚中島康彦奈良先端大ICD2010-115 エレソ技報アーカイブへのリンク:ICD2010-115
抄録 (和) 我々は,VLIWプロセッサと演算器アレイから構成されている演算器アレイ型アクセラレータ(LAPP)を提案している.本アクセラレータは,既存の機械語命令列を演算器アレイに写像し,フロントエンド及び未使用演算ユニットを停止させ,低消費電力化を図るという特徴を有する.本ポスターでは,本アクセラレータの演算器間ネットワークの設計を報告する.本ネットワークのレジスタ値伝播機構は演算器に写像された命令のレジスタ番号を比較し,必要なレジスタ値のみを各段へ伝播させる.HDL記述による設計結果より,本機構の遅延時間が5.74 FO4であることが明らかになり,本ネットワークがLAPPのクリティカルパスにならないことが分かった. 
(英) We have proposed Linear Array Pipeline Processor (LAPP) as a special implementation of Function Unit (FU) array based accelerator. Its VLIW processor as the front-end part and the unmapped FU can be power-gated to ensure an energy-efficiency design, running well mapped conventional VLIW instructions. In this poster, we will introduce an FU network design for LAPP, which traces register numbers appearing in mapped instructions and then propagates minimum necessary register values to successive array stages. According to an HDL implementation, the delay time of the selector is 5.74 FO4. The result shows that the selectors will not extend any critical path in LAPP.
キーワード (和) 演算器アレイ / VLIW / 演算器間ネットワーク / リコンフィギャラブルアーキテクチャ / / / /  
(英) array execution units / VLIW / FU Network / instruction mapping / reconfigurable architecture / / /  
文献情報 信学技報, vol. 110, no. 344, ICD2010-115, pp. 97-99, 2010年12月.
資料番号 ICD2010-115 
発行日 2010-12-09 (ICD) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード ICD2010-115 エレソ技報アーカイブへのリンク:ICD2010-115

研究会情報
研究会 ICD  
開催期間 2010-12-16 - 2010-12-17 
開催地(和) 東京大学 先端科学技術研究センター 
開催地(英) RCAST, Univ. of Tokyo 
テーマ(和) 学生・若手研究会 
テーマ(英) Workshop for Graduate Student and Young Researchers 
講演論文情報の詳細
申込み研究会 ICD 
会議コード 2010-12-ICD 
本文の言語 日本語 
タイトル(和) アレイ型アクセラレータにおける演算器間ネットワークの設計 
サブタイトル(和)  
タイトル(英) Design of An FU Network for Array Accelerators 
サブタイトル(英)  
キーワード(1)(和/英) 演算器アレイ / array execution units  
キーワード(2)(和/英) VLIW / VLIW  
キーワード(3)(和/英) 演算器間ネットワーク / FU Network  
キーワード(4)(和/英) リコンフィギャラブルアーキテクチャ / instruction mapping  
キーワード(5)(和/英) / reconfigurable architecture  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 大上 俊 / Suguru Ooue / オオウエ スグル
第1著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
Nara Institute of Science and Technology (略称: NAIST)
第2著者 氏名(和/英/ヨミ) 岩上 拓矢 / Takuya Iwakami / イワカミ タクヤ
第2著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
Nara Institute of Science and Technology (略称: NAIST)
第3著者 氏名(和/英/ヨミ) 吉村 和浩 / Kazuhiro Yoshimura / ヨシムラ カズヒロ
第3著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
Nara Institute of Science and Technology (略称: NAIST)
第4著者 氏名(和/英/ヨミ) 中田 尚 / Takashi Nakada / ナカダ タカシ
第4著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
Nara Institute of Science and Technology (略称: NAIST)
第5著者 氏名(和/英/ヨミ) 中島 康彦 / Yasuhiko Nakashima /
第5著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
Nara Institute of Science and Technology (略称: NAIST)
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講演者 第1著者 
発表日時 2010-12-16 15:10:00 
発表時間 120分 
申込先研究会 ICD 
資料番号 ICD2010-115 
巻番号(vol) vol.110 
号番号(no) no.344 
ページ範囲 pp.97-99 
ページ数
発行日 2010-12-09 (ICD) 


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