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| 講演抄録／キーワード | ||
| 講演名 | 2011-01-17 14:30 AllianceVHDLツールセットによるROHM0.18μｍチップ試作検証 ～ 配置配線検証ツールの試行 ～ ○細川達也・今井紘士（東海大）・清水尚彦（東海大/IP ARCH）  VLD2010-93 CPSY2010-48 RECONF2010-62 |
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| 抄録 | （和） | 本論文ではLSI 設計には欠かせない配置配線の検証をAllianceCAD ツールでいかに行うか、ということ を述べる。このツール群にはそのためのツールが用意されているが、ドキュメントが整備されておらず、不明なとこ ろが多く正当性の確認もされていない。しかし、Alliance はオープンソースで提供されているツール群のため、これ らのツールを解析し、詳細な使用方法を確立しようと試みている。本論文で述べている内容は未だ研究途中のもので あり、現時点で判明している、Lvx での比較方法やrds ファイルへのルール記述などを述べるものである。 |
| （英） | In this paper, We describe about LSI design with an Alliance CAD tools. An alliance CAD tools is not enough description of documents. And, don't check justice. But it provide for free. So, we analyze it tools. And we will try to build up detail usage. In this study don't nish. Although, we describe comparative way with Lvx, and description of design rule for tecnology le with Druc. |
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| キーワード | （和） | Alliance / Cougar / Lvx / Druc / チップ設計 / ネットリスト検証 / レイアウト検証 / |
| （英） | Alliance / Cougar / Lvx / Druc / Chip Design, / Leyout Versus Schematic / Design Rule Check / | |
| 文献情報 | 信学技報, vol. 110, no. 360, VLD2010-93, pp. 55-61, 2011年1月. | |
| 資料番号 | VLD2010-93 | |
| 発行日 | 2011-01-10 (VLD, CPSY, RECONF) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2010-93 CPSY2010-48 RECONF2010-62 |
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| 研究会情報 | |
| 研究会 | RECONF VLD CPSY IPSJ-SLDM |
| 開催期間 | 2011-01-17 - 2011-01-18 |
| 開催地（和） | 慶應義塾大学日吉キャンパス |
| 開催地（英） | Keio Univ (Hiyoshi Campus) |
| テーマ（和） | FPGA応用および一般 |
| テーマ（英） | FPGA Applications, etc |
| 講演論文情報の詳細 | |
| 申込み研究会 | VLD |
| 会議コード | 2011-01-RECONF-VLD-CPSY-SLDM |
| 本文の言語 | 日本語 |
| タイトル（和） | AllianceVHDLツールセットによるROHM0.18μｍチップ試作検証 |
| サブタイトル（和） | 配置配線検証ツールの試行 |
| タイトル（英） | Design and check a ROHM 0.18μm chip with Alliance VHDL toolset |
| サブタイトル（英） | Trial the layout and netlist check tools |
| キーワード(1)（和/英） | Alliance / Alliance |
| キーワード(2)（和/英） | Cougar / Cougar |
| キーワード(3)（和/英） | Lvx / Lvx |
| キーワード(4)（和/英） | Druc / Druc |
| キーワード(5)（和/英） | チップ設計 / Chip Design, |
| キーワード(6)（和/英） | ネットリスト検証 / Leyout Versus Schematic |
| キーワード(7)（和/英） | レイアウト検証 / Design Rule Check |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 細川 達也 / Tatsuya Hosokawa / ホソカワ タツヤ |
| 第1著者 所属（和/英） | 東海大学 (略称： 東海大) Tokai University (略称： Tokai Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 今井 紘士 / Hiroshi Imai / イマイ ヒロシ |
| 第2著者 所属（和/英） | 東海大学 (略称： 東海大) Tokai University (略称： Tokai Univ.) |
| 第3著者 氏名（和/英/ヨミ） | 清水 尚彦 / Naohiko Shimizu / シミズ ナオヒコ |
| 第3著者 所属（和/英） | 東海大学 (略称： 東海大/IP ARCH) Tokai University (略称： Tokai Univ.) |
| 第4著者 氏名（和/英/ヨミ） | / / |
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| 講演者 | 第1著者 |
| 発表日時 | 2011-01-17 14:30:00 |
| 発表時間 | 20分 |
| 申込先研究会 | VLD |
| 資料番号 | VLD2010-93, CPSY2010-48, RECONF2010-62 |
| 巻番号（vol） | vol.110 |
| 号番号（no） | no.360(VLD), no.361(CPSY), no.362(RECONF) |
| ページ範囲 | pp.55-61 |
| ページ数 | 7 |
| 発行日 | 2011-01-10 (VLD, CPSY, RECONF) |
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