講演抄録/キーワード |
講演名 |
2012-01-20 15:10
同期/非同期ハイブリッドアーキテクチャに基づく低消費電力FPGAの評価 ○小松与志也・張山昌論・石原翔太・土屋亮人・亀山充隆(東北大) ICD2011-142 エレソ技報アーカイブへのリンク:ICD2011-142 |
抄録 |
(和) |
本論文では回路の稼働率に応じて同期式あるいは非同期式に回路の動作を選択できるハイブリッドFPGAを提案する.ロジックブロックやスイッチブロック等のデータパスを構成するコンポーネントは同期式回路モードと非同期式回路モードを持つよう構成されている.また,同期式回路と非同期式回路の間の通信は一般的にFIFOを介して行われるが,本論文ではロジックブロックを用いて効率的にFIFOを構成する手法を提案する.提案FPGAを65nmプロセスで試作し評価を行った. |
(英) |
This paper presents an FPGA architecture that combines synchronous and asynchronous architectures. Datapath components such as logic blocks and switch blocks are designed so as to run in asynchronous and synchronous modes. Moreover, a logic block is presented that implements area-efficient First-in-first-out(FIFO) interfaces, which are usually used for communication between synchronous and asynchronous logic cores. The FPGA based on the hybrid architecture is fabricated in a 65nm process. |
キーワード |
(和) |
FPGA / リコンフィギャラブルVLSI / セルフタイムドアーキテクチャ / 遅延インセンシティブアーキテクチャ / / / / |
(英) |
FPGA / Reconfigurable VLSI / Self-timed architecture / Delay-insensitive architecture / / / / |
文献情報 |
信学技報, vol. 111, no. 388, ICD2011-142, pp. 93-96, 2012年1月. |
資料番号 |
ICD2011-142 |
発行日 |
2012-01-12 (ICD) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
PDFダウンロード |
ICD2011-142 エレソ技報アーカイブへのリンク:ICD2011-142 |