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| 講演抄録／キーワード | ||
| 講演名 | 2012-01-25 14:55 多電源可変パイプラインルータにおける電源ドメインサイズの解析 ○中村武雄・松谷宏紀（慶大）・鯉渕道絋（NII）・宇佐美公良（芝浦工大）・天野英晴（慶大）  VLD2011-99 CPSY2011-62 RECONF2011-58 |
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| 抄録 | （和） | 我々はメニーコアにおけるネットワークオンチップ（Network-on-Chip）を低消費電力化するために多電源可変パイプラインルータを提案してきた．本論文では，NoC の電源切り替えを，入力仮想チャネル，入力(物理) チャネルなどのコンポーネント単位，ルータ・ルータクラスタ単位の3 つの粒度で行った場合のエネルギーオーバーヘッド，動作周波数，遅延を各々シミュレーションにより評価した．その結果，動作周波数が386.5HMz の場合，Vdd-lowとVdd-high 間の移行遅延はいずれの粒度も1 サイクル以内となることが分かった．また損益分岐点(Break-even Time:BET) は入力仮想チャネル単位，入力物理チャネル単位，ルータ・ルータクラスタ単位で電力制御を行った場合，各々26，19，17 サイクルとなった． |
| （英） | We have proposed a multi-voltage variable-pipeline router in order to reduce power consumption ofNetwork-on-Chip (NoC). In this paper, we evaluated energy overhead, operating frequency, and delay of three domain patterns for switching the power supply: component-level such as virtual channels, router-level, and router-cluster-level(router x4) domaiins. As a result, when the operating frequency is 386.5HMz, switching delay between Vdd-low and Vdd-high is within a single clock cycle. Their break-even times (BETs) are 26, 19, 17 cycle, respectively. | |
| キーワード | （和） | ネットワークオンチップ / 低消費電力 / プロセッサ / 可変パイプライン / / / / |
| （英） | Network-on-chip / Low Power / Processor / Variable pipline / / / / | |
| 文献情報 | 信学技報, vol. 111, no. 398, CPSY2011-62, pp. 49-54, 2012年1月. | |
| 資料番号 | CPSY2011-62 | |
| 発行日 | 2012-01-18 (VLD, CPSY, RECONF) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2011-99 CPSY2011-62 RECONF2011-58 |
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| 研究会情報 | |
| 研究会 | VLD CPSY RECONF IPSJ-SLDM |
| 開催期間 | 2012-01-25 - 2012-01-26 |
| 開催地（和） | 慶応義塾大学 日吉キャンパス |
| 開催地（英） | Hiyoshi Campus, Keio University |
| テーマ（和） | 「FPGA応用および一般」 |
| テーマ（英） | FPGA Applications, etc |
| 講演論文情報の詳細 | |
| 申込み研究会 | CPSY |
| 会議コード | 2012-01-VLD-CPSY-RECONF-SLDM |
| 本文の言語 | 日本語 |
| タイトル（和） | 多電源可変パイプラインルータにおける電源ドメインサイズの解析 |
| サブタイトル（和） | |
| タイトル（英） | Analysis of Power Domain Sizes on Multi-Vdd Variable-Pipeline Router |
| サブタイトル（英） | |
| キーワード(1)（和/英） | ネットワークオンチップ / Network-on-chip |
| キーワード(2)（和/英） | 低消費電力 / Low Power |
| キーワード(3)（和/英） | プロセッサ / Processor |
| キーワード(4)（和/英） | 可変パイプライン / Variable pipline |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 中村 武雄 / Takeo Nakamura / ナカムラ タケオ |
| 第1著者 所属（和/英） | 慶應義塾大学 (略称： 慶大) Keio University (略称： Keio Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 松谷 宏紀 / Hiroki Matsutani / マツタ ニヒロキ |
| 第2著者 所属（和/英） | 慶應義塾大学 (略称： 慶大) Keio University (略称： Keio Univ.) |
| 第3著者 氏名（和/英/ヨミ） | 鯉渕 道絋 / Mitihiro Koibuchi / コイブチ ミチヒロ |
| 第3著者 所属（和/英） | 国立情報学研究所 (略称： NII) National Institute of Informatics (略称： NII) |
| 第4著者 氏名（和/英/ヨミ） | 宇佐美 公良 / Kimiyoshi Usami / ウサミ キミヨシ |
| 第4著者 所属（和/英） | 芝浦工業大学 (略称： 芝浦工大) Shibaura Institute of Technology (略称： Shibaura Inst. of Tech.) |
| 第5著者 氏名（和/英/ヨミ） | 天野 英晴 / Hideharu Amano / アマノ ヒデハル |
| 第5著者 所属（和/英） | 慶應義塾大学 (略称： 慶大) Keio University (略称： Keio Univ.) |
| 講演者 | 第1著者 |
| 発表日時 | 2012-01-25 14:55:00 |
| 発表時間 | 25分 |
| 申込先研究会 | CPSY |
| 資料番号 | VLD2011-99, CPSY2011-62, RECONF2011-58 |
| 巻番号（vol） | vol.111 |
| 号番号（no） | no.397(VLD), no.398(CPSY), no.399(RECONF) |
| ページ範囲 | pp.49-54 |
| ページ数 | 6 |
| 発行日 | 2012-01-18 (VLD, CPSY, RECONF) |
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