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| 講演抄録／キーワード | ||
| 講演名 | 2014-10-02 16:40 タイル・ライン両アクセス対応キャッシュメモリの提案 ○王 宝康・深澤祐樹・近藤利夫・佐々木敬泰（三重大）  VLD2014-67 ICD2014-60 IE2014-46 |
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| 抄録 | （和） | 従来のラスタ走査順の処理を前提としたキャッシュメモリでは, 2次元以上のアクセス局所性を備えたデータの高効率処理には向かない.例えば, 符号化処理の約80%を占める動き探索処理では, SIMD処理の高並列化により高速化を図ろうとしても, アクセスの2次元的な局所性に対応できないことで頻発する競合性ミスや不要データ転送による転送効率低下がそのボトルネックとなる. 本報告では, このボトルネック解消に向け, 競合性ミス, データ転送の不要データ割合を最小限とする階層的なタイル形式データを従来同様のラスタ形式データとしてアクセス可能とするタイル・ライン両対応キャッシュメモリの機能・構成法を示し, 標準のダイレクトマップキャッシュに対し, 周辺回路規模増加の割合が107%, レイテンシの増加がリード, ライト共に1サイクルで済むことを明らかにした. |
| （英） | A cache memory subject to the process of conventional raster scan order is not suitable for efficient data process with locality of reference for more than 2-dimensions. For example, for motion estimation process which account for approximately 80% of the encoding process, even speeding up by the high parallel of the SIMD process, because it can not support 2-dimensional locality, frequent conflict miss or decline of transfer efficiency due to unnecessary data swap become the bottleneck. In this report, to eliminate the bottleneck, minimize conflict misses and unnecessary data swap, we proposed a cache memory with line and tile data accessibility which regard hierarchical tile data as conventional raster data to access and shown the function and configuration method of the proposed cache memory. Compared with conventional direct-mapped cache memory, it revealed that the increase of peripheral circuit scale is about 107% and both read and write process need one more cycle. | |
| キーワード | （和） | H.264 / 動き探索 / データ局所性 / / / / / |
| （英） | H.264 / Motion Estimation / data locality / / / / / | |
| 文献情報 | 信学技報, vol. 114, no. 232, ICD2014-60, pp. 39-44, 2014年10月. | |
| 資料番号 | ICD2014-60 | |
| 発行日 | 2014-09-25 (VLD, ICD, IE) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2014-67 ICD2014-60 IE2014-46 |
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| 研究会情報 | |
| 研究会 | IE ICD VLD IPSJ-SLDM |
| 開催期間 | 2014-10-02 - 2014-10-03 |
| 開催地（和） | 東北大学 さくらホール |
| 開催地（英） | |
| テーマ（和） | システムLSIの応用とその要素技術，専用プロセッサ，プロセッサ，DSP，画像処理技術，および一般 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | ICD |
| 会議コード | 2014-10-IE-ICD-VLD-SLDM |
| 本文の言語 | 日本語 |
| タイトル（和） | タイル・ライン両アクセス対応キャッシュメモリの提案 |
| サブタイトル（和） | |
| タイトル（英） | A Cache Memory with Line and Tile Data Accessibility |
| サブタイトル（英） | |
| キーワード(1)（和/英） | H.264 / H.264 |
| キーワード(2)（和/英） | 動き探索 / Motion Estimation |
| キーワード(3)（和/英） | データ局所性 / data locality |
| キーワード(4)（和/英） | / |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 王 宝康 / Baokang Wang / オウ ホウコウ |
| 第1著者 所属（和/英） | 三重大学 (略称： 三重大) Mie University (略称： Mie Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 深澤 祐樹 / Yuki Fukazawa / フカザワ ユキ |
| 第2著者 所属（和/英） | 三重大学 (略称： 三重大) Mie University (略称： Mie Univ.) |
| 第3著者 氏名（和/英/ヨミ） | 近藤 利夫 / Toshio Kondo / コンドウ トシオ |
| 第3著者 所属（和/英） | 三重大学 (略称： 三重大) Mie University (略称： Mie Univ.) |
| 第4著者 氏名（和/英/ヨミ） | 佐々木 敬泰 / Takahiro Sasaki / ササキ タカヒロ |
| 第4著者 所属（和/英） | 三重大学 (略称： 三重大) Mie University (略称： Mie Univ.) |
| 講演者 | 第1著者 |
| 発表日時 | 2014-10-02 16:40:00 |
| 発表時間 | 25分 |
| 申込先研究会 | ICD |
| 資料番号 | VLD2014-67, ICD2014-60, IE2014-46 |
| 巻番号（vol） | vol.114 |
| 号番号（no） | no.231(VLD), no.232(ICD), no.233(IE) |
| ページ範囲 | pp.39-44 |
| ページ数 | 6 |
| 発行日 | 2014-09-25 (VLD, ICD, IE) |
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