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講演抄録/キーワード
講演名 2016-03-25 14:30
Design Evaluation of Low-Latency Handshake Join on FPGA
Masato YoshimiYasin OgeCelimuge WuTsutomu YoshinagaUECCPSY2015-155 DC2015-109
抄録 (和) This work revisits the processing of sliding-window joins on FPGAs. In this paper, we propose an FPGA-based implementation of low-latency handshake join algorithm and present a detailed evaluation of the proposed design. The proposed design overcomes the limitation of the previous works by reducing the latency overhead. Our experiments show that the proposed low-latency handshake join hardware can achieve linear scalability with respect to the number of join cores without sacrificing latency (e.g., nearly 7 million tuples per second of throughput with less than a micro-second of latency). Evaluation results also indicate that the proposed design significantly outperforms the software-based approach in terms of both latency and throughput 
(英) This work revisits the processing of sliding-window joins on FPGAs. In this paper, we propose an FPGA-based implementation of low-latency handshake join algorithm and present a detailed evaluation of the proposed design. The proposed design overcomes the limitation of the previous works by reducing the latency overhead. Our experiments show that the proposed low-latency handshake join hardware can achieve linear scalability with respect to the number of join cores without sacrificing latency (e.g., nearly 7 million tuples per second of throughput with less than a micro-second of latency). Evaluation results also indicate that the proposed design significantly outperforms the software-based approach in terms of both latency and throughput
キーワード (和) FPGA / query processing / data stream / sliding-window join / low-latency handshake join / / /  
(英) FPGA / query processing / data stream / sliding-window join / low-latency handshake join / / /  
文献情報 信学技報, vol. 115, no. 518, CPSY2015-155, pp. 253-258, 2016年3月.
資料番号 CPSY2015-155 
発行日 2016-03-17 (CPSY, DC) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
査読に
ついて
本技術報告は査読を経ていない技術報告であり,推敲を加えられていずれかの場に発表されることがあります.
PDFダウンロード CPSY2015-155 DC2015-109

研究会情報
研究会 CPSY DC IPSJ-SLDM IPSJ-EMB IPSJ-ARC  
開催期間 2016-03-24 - 2016-03-25 
開催地(和) 福江文化会館・勤労福祉センター 
開催地(英) Fukue Bunka Hall/Rodou Fukushi Center 
テーマ(和) 組込み技術とネットワークに関するワークショップ ETNET2016 
テーマ(英) ETNET2016 
講演論文情報の詳細
申込み研究会 CPSY 
会議コード 2016-03-CPSY-DC-SLDM-EMB-ARC 
本文の言語 英語 
タイトル(和)  
サブタイトル(和)  
タイトル(英) Design Evaluation of Low-Latency Handshake Join on FPGA 
サブタイトル(英)  
キーワード(1)(和/英) FPGA / FPGA  
キーワード(2)(和/英) query processing / query processing  
キーワード(3)(和/英) data stream / data stream  
キーワード(4)(和/英) sliding-window join / sliding-window join  
キーワード(5)(和/英) low-latency handshake join / low-latency handshake join  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 吉見 真聡 / Masato Yoshimi / ヨシミ マサト
第1著者 所属(和/英) 電気通信大学 (略称: 電通大)
University of Electro-Communications (略称: UEC)
第2著者 氏名(和/英/ヨミ) オゲ ヤースィン / Yasin Oge / オゲ ヤースィン
第2著者 所属(和/英) 電気通信大学 (略称: 電通大)
University of Electro-Communications (略称: UEC)
第3著者 氏名(和/英/ヨミ) 策力 木格 / Celimuge Wu / チリ ムゲ
第3著者 所属(和/英) 電気通信大学 (略称: 電通大)
University of Electro-Communications (略称: UEC)
第4著者 氏名(和/英/ヨミ) 吉永 努 / Tsutomu Yoshinaga / ヨシナガ ツトム
第4著者 所属(和/英) 電気通信大学 (略称: 電通大)
University of Electro-Communications (略称: UEC)
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講演者 第1著者 
発表日時 2016-03-25 14:30:00 
発表時間 25分 
申込先研究会 CPSY 
資料番号 CPSY2015-155, DC2015-109 
巻番号(vol) vol.115 
号番号(no) no.518(CPSY), no.519(DC) 
ページ範囲 pp.253-258 
ページ数
発行日 2016-03-17 (CPSY, DC) 


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