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講演抄録/キーワード
講演名 2016-12-15 11:20
三次元積層チップにおける可変パイプライン型超低電力再構成可能アクセラレータの実装
安藤尚輝増山滉一郎天野英晴慶大ICD2016-54 CPSY2016-60
抄録 (和) ビルディングブロック型計算システムは、小規模なチップを誘導結合ワイヤレスチップ間接続TCI(Thru-Chip Interface)により接続することで、様々なシステムを構築できる。このプロトタイプ2号機であるCube-2はR3000コンパチブルなホストCPU、再構成可能リコンフィギャラブルアクセラレータCC-SOTB2、ニューラルネットワーク 用アクセラレータSNACC、データベース処理用アクセラレータKVS PEが積層される。本稿では、CC-SOTB2での処理を中心にCube-2におけるホストと複数のアクセラレータ間のデータ転送方式について述べる。 
(英) (Not available yet)
キーワード (和) 三次元積層 / TCI / パイプライン / ニューラルネットワーク / Key Value Store / R3000 / ビルディングブロック /  
(英) / / / / / / /  
文献情報 信学技報, vol. 116, no. 365, CPSY2016-60, pp. 19-24, 2016年12月.
資料番号 CPSY2016-60 
発行日 2016-12-08 (ICD, CPSY) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード ICD2016-54 CPSY2016-60

研究会情報
研究会 ICD CPSY  
開催期間 2016-12-15 - 2016-12-16 
開催地(和) 東京工業大学 
開催地(英) Tokyo Institute of Technology 
テーマ(和) 学生・若手研究会 
テーマ(英)  
講演論文情報の詳細
申込み研究会 CPSY 
会議コード 2016-12-ICD-CPSY 
本文の言語 日本語 
タイトル(和) 三次元積層チップにおける可変パイプライン型超低電力再構成可能アクセラレータの実装 
サブタイトル(和)  
タイトル(英) A Variable Pipeline Reconfigurable Accelerator in 3-D stack implementation 
サブタイトル(英)  
キーワード(1)(和/英) 三次元積層 /  
キーワード(2)(和/英) TCI /  
キーワード(3)(和/英) パイプライン /  
キーワード(4)(和/英) ニューラルネットワーク /  
キーワード(5)(和/英) Key Value Store /  
キーワード(6)(和/英) R3000 /  
キーワード(7)(和/英) ビルディングブロック /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 安藤 尚輝 / Naoki Ando / アンドウ ナオキ
第1著者 所属(和/英) 慶應義塾大学 (略称: 慶大)
Keio University (略称: Keio Univ.)
第2著者 氏名(和/英/ヨミ) 増山 滉一郎 / Koichiro Masuyama / マスヤマ コウイチロウ
第2著者 所属(和/英) 慶應義塾大学 (略称: 慶大)
Keio University (略称: Keio Univ.)
第3著者 氏名(和/英/ヨミ) 天野 英晴 / Hideharu Amano / アマノ ヒデハル
第3著者 所属(和/英) 慶應義塾大学 (略称: 慶大)
Keio University (略称: Keio Univ.)
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講演者 第1著者 
発表日時 2016-12-15 11:20:00 
発表時間 25分 
申込先研究会 CPSY 
資料番号 ICD2016-54, CPSY2016-60 
巻番号(vol) vol.116 
号番号(no) no.364(ICD), no.365(CPSY) 
ページ範囲 pp.19-24 
ページ数
発行日 2016-12-08 (ICD, CPSY) 


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