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| 講演抄録／キーワード | ||
| 講演名 | 2018-10-29 14:55 Q-RNS MR アルゴリズムのFPGA実装時における最適な基底選択と評価 ○郡 義弘・藤本大介・林 優一（奈良先端大）・本間尚文（東北大）  HWS2018-51 ICD2018-43 |
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| 抄録 | （和） | 公開鍵暗号演算の高速実装法として、モンゴメリ・リダクション(MR)を整数の表現法であるRNS(Residue Number System)を用いて表現することで、公開鍵暗号演算の剰余計算を高速に実行する手法が提案されている。上述の手法が提案された後、複数のアルゴリズムの改良が提案されているが、これらの改良は演算内部における最適化に留まっていた。これに対し、係数の移動により複数回の演算に跨って最適化を行うQ-RNS MR アルゴリズムが提案され演算の高速化が期待されている。一方、Q-RNS MR アルゴリズムの性能評価は理論上のステップ数のみが行われており、乗算器の数やクリティカルパス遅延を左右し、実装時の性能に大きな影響を与える重要なパラメータの１つであるRNS表現における基底に関する議論はこの手法において十分に行われていない。そこで、本研究ではQ-RNS MR アルゴリズムのFPGA実装を行う際に使用する最適な基底の選択と評価を行う |
| （英） | To improve a computation speed of public cryptography, Montgomery Reduction(MR) and Residue Number System (RNS) are often applied for Modular multiplications. So far, several improved algorithms have been proposed since the proposal of this method, but these algorithms have been limited to optimization within a single computation. On the other hand, a Q-RNS MR algorithm has been proposed. This algorithm focuses on plural calculations and performs optimization by movement of coefficients. However, it is not clear that performance evaluation of this algorithm on an actual circuit because the performance depends on the number and size of basis. In this research, we aim to investigate the suitable bases for implementation by implementing FPGA implementation of the Q-RNSMR algorithm, to implement public key cryptosystem using the Q-RNSMR algorithm and circuit performance evaluation using a selected basis. | |
| キーワード | （和） | RNS / FPGA / Q-RNS / モンゴメリ乗算 / / / / |
| （英） | RNS / FPGA / Q-RNS / Montgomery multiplication / / / / | |
| 文献情報 | 信学技報, vol. 118, no. 272, HWS2018-51, pp. 25-30, 2018年10月. | |
| 資料番号 | HWS2018-51 | |
| 発行日 | 2018-10-22 (HWS, ICD) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | HWS2018-51 ICD2018-43 |
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| 研究会情報 | |
| 研究会 | HWS ICD |
| 開催期間 | 2018-10-29 - 2018-10-29 |
| 開催地（和） | 神戸大 梅田インテリジェントラボラトリ |
| 開催地（英） | Kobe Univ. Umeda Intelligent Laboratory |
| テーマ（和） | ハードウェアセキュリティ, 一般 |
| テーマ（英） | HardwareSecurity, etc. |
| 講演論文情報の詳細 | |
| 申込み研究会 | HWS |
| 会議コード | 2018-10-HWS-ICD |
| 本文の言語 | 日本語 |
| タイトル（和） | Q-RNS MR アルゴリズムのFPGA実装時における最適な基底選択と評価 |
| サブタイトル（和） | |
| タイトル（英） | Selection and evaluation of optimal bases in the case of implementing Q-RNS MR algorithm in FPGA |
| サブタイトル（英） | |
| キーワード(1)（和/英） | RNS / RNS |
| キーワード(2)（和/英） | FPGA / FPGA |
| キーワード(3)（和/英） | Q-RNS / Q-RNS |
| キーワード(4)（和/英） | モンゴメリ乗算 / Montgomery multiplication |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 郡 義弘 / Yoshihiro Kori / コオリ ヨシヒロ |
| 第1著者 所属（和/英） | 奈良先端科学技術大学院大学 (略称： 奈良先端大) Nara Institute of Science and Technology (略称： NAIST) |
| 第2著者 氏名（和/英/ヨミ） | 藤本 大介 / Daisuke Fujimoto / フジモト ダイスケ |
| 第2著者 所属（和/英） | 奈良先端科学技術大学院大学 (略称： 奈良先端大) Nara Institute of Science and Technology (略称： NAIST) |
| 第3著者 氏名（和/英/ヨミ） | 林 優一 / Yu-ichi Hayasi / ハヤシ ユウイチ |
| 第3著者 所属（和/英） | 奈良先端科学技術大学院大学 (略称： 奈良先端大) Nara Institute of Science and Technology (略称： NAIST) |
| 第4著者 氏名（和/英/ヨミ） | 本間 尚文 / Naofumi Homma / ホンマ ナオフミ |
| 第4著者 所属（和/英） | 東北大学 (略称： 東北大) Tohoku University (略称： Tohoku Univ.) |
| 講演者 | 第1著者 |
| 発表日時 | 2018-10-29 14:55:00 |
| 発表時間 | 25分 |
| 申込先研究会 | HWS |
| 資料番号 | HWS2018-51, ICD2018-43 |
| 巻番号（vol） | vol.118 |
| 号番号（no） | no.272(HWS), no.273(ICD) |
| ページ範囲 | pp.25-30 |
| ページ数 | 6 |
| 発行日 | 2018-10-22 (HWS, ICD) |
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