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| 講演抄録／キーワード | ||
| 講演名 | 2021-01-25 13:45 FPGA内蔵高速トランシーバーを用いたResponsive Linkの高スループット化 ○高橋真彦・山﨑信行（慶大）  VLD2020-46 CPSY2020-29 RECONF2020-65 |
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| 抄録 | （和） | リアルタイムシステムは処理結果の正確さだけでなく決められた時間内での実行完了も求められるという制約がある．この時間の制約をシステム全体でも満たすようにしなければならない．複数プロセッサをネットワークで接続することで構成される分散リアルタイムシステムにおいては，システム全体でも時間制約を満たすために通信においても時間制約を守ることを保証しなければならない．リアルタイム通信規格であるResponsive Link は，優先度によるパケットの追い越し機能により通信においても時間制約の保証を行う．本研究では，現在一部のASIC のみに実装されているResponsive Link をXilinx 社のArtix7 FPGA に搭載されているGTP トランシーバーを用いて実装を行い低レイテンシかつ高スループット通信の実現を行った．トランシーバーの最高性能に近い6.25 GHz で通信を行い，64 Byte のパケットを通信路が混雑した環境下でも333 ns で隣接ノードへ転送することを実機で確認した． |
| （英） | In a real-time system, there is a requirement that not only the accuracy of the processing result but also the execution completion within a deadline. The system as a whole must meet this time constraint. Distributed real-time system consist of connecting multiple processors via a network. In this system, it must be guaranteed that the time constraint is met in communication in order to satisfy the time constraint in the entire system. Responsive Link, a real-time communication standard, has a packet overtaking function based on priority in order to make real-time scheduling feasible even in communication. In this study, we implemented Responsive Link, which is currently implemented only in few ASIC, using the GTP transceiver installed in Xilinx’s Artix7 FPGA, and realized low-latency and high-throughput communication. It was confirmed on the actual machine that it communicates at 6.25 GHz, which is close to the highest performance of the transceiver, and forwards a 64-Byte packet to an adjacent node with 333 ns. | |
| キーワード | （和） | Responsive Link / 組込みリアルタイムシステム / Xilinx FPGA / GTP トランシーバー / / / / |
| （英） | Responsive Link / real-time system / Xilinx FPGA / GTP Transceiver / / / / | |
| 文献情報 | 信学技報, vol. 120, no. 338, CPSY2020-29, pp. 40-45, 2021年1月. | |
| 資料番号 | CPSY2020-29 | |
| 発行日 | 2021-01-18 (VLD, CPSY, RECONF) | |
| ISSN | Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2020-46 CPSY2020-29 RECONF2020-65 |
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| 研究会情報 | |
| 研究会 | CPSY RECONF VLD IPSJ-ARC IPSJ-SLDM |
| 開催期間 | 2021-01-25 - 2021-01-26 |
| 開催地（和） | オンライン開催 |
| 開催地（英） | Online |
| テーマ（和） | FPGA 応用および一般 |
| テーマ（英） | FPGA Applications, etc. |
| 講演論文情報の詳細 | |
| 申込み研究会 | CPSY |
| 会議コード | 2021-01-CPSY-RECONF-VLD-ARC-SLDM |
| 本文の言語 | 日本語 |
| タイトル（和） | FPGA内蔵高速トランシーバーを用いたResponsive Linkの高スループット化 |
| サブタイトル（和） | |
| タイトル（英） | Throughput improvement of Responsive Link with High Speed Transceiver in FPGA |
| サブタイトル（英） | |
| キーワード(1)（和/英） | Responsive Link / Responsive Link |
| キーワード(2)（和/英） | 組込みリアルタイムシステム / real-time system |
| キーワード(3)（和/英） | Xilinx FPGA / Xilinx FPGA |
| キーワード(4)（和/英） | GTP トランシーバー / GTP Transceiver |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 高橋 真彦 / Masahiko Takahashi / タカハシ マサヒコ |
| 第1著者 所属（和/英） | 慶應義塾大学 (略称： 慶大) Keio University (略称： Keio Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 山﨑 信行 / Yamasaki Nobuyuki / ヤマサキ ノブユキ |
| 第2著者 所属（和/英） | 慶應義塾大学 (略称： 慶大) Keio University (略称： Keio Univ.) |
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| 講演者 | 第1著者 |
| 発表日時 | 2021-01-25 13:45:00 |
| 発表時間 | 25分 |
| 申込先研究会 | CPSY |
| 資料番号 | VLD2020-46, CPSY2020-29, RECONF2020-65 |
| 巻番号（vol） | vol.120 |
| 号番号（no） | no.337(VLD), no.338(CPSY), no.339(RECONF) |
| ページ範囲 | pp.40-45 |
| ページ数 | 6 |
| 発行日 | 2021-01-18 (VLD, CPSY, RECONF) |
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