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| 講演抄録／キーワード | ||
| 講演名 | 2025-01-16 10:30 時系列データを対象とする分位点探索のFPGA実装 ○河内 陸・佐藤幸紀（豊橋技科大）  VLD2024-79 RECONF2024-109 |
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| 抄録 | （和） | 近年，時系列データの処理は金融，IoTシステム，社会インフラ，交通システムなど幅広い分野で重要性を増している．その中でも分位点探索は外れ値の検出などの異常検知の分野で用いられる．しかしながら，時系列データの処理は膨大なデータ量への対応が必要な上，特にハードウェア性能や消費電力などの制約が多い組込みシステムの分野ではリアルタイム性が求められている．従来のソフトウェアベースの手法では，スループット的な要求制約を満たせない場合や，消費電力的な制約から単純に適応することが困難である．本研究では，分位点探索アルゴリズムをFPGA上に実装した．提案するアルゴリズムは，時系列データの分位点を逐次的に求めるためにヒープ構造を用い，その並列化を行った．また，厳密な分位点を求めながらも，大規模データへの対応や動的なスケーリングをを可能とした．結果，AMD社製のZCU104ボードにおいて，分位点探索の要素数が1から2097151までの探索がスループットを落とさずに可能であることが示された． |
| （英） | ||
| キーワード | （和） | 分位点探索 / FPGA / 高位合成 / / / / / |
| （英） | / / / / / / / | |
| 文献情報 | 信学技報, vol. 124, no. 330, RECONF2024-109, pp. 18-22, 2025年1月. | |
| 資料番号 | RECONF2024-109 | |
| 発行日 | 2025-01-09 (VLD, RECONF) | |
| ISSN | Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2024-79 RECONF2024-109 |
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| 研究会情報 | |
| 研究会 | VLD RECONF |
| 開催期間 | 2025-01-16 - 2025-01-17 |
| 開催地（和） | キオクシア 横浜テクノロジーキャンパス Flagship棟 |
| 開催地（英） | Yokohama Technology Campus Flagship Building |
| テーマ（和） | FPGA 応用および一般 |
| テーマ（英） | FPGA Applications, etc. |
| 講演論文情報の詳細 | |
| 申込み研究会 | RECONF |
| 会議コード | 2025-01-VLD-RECONF |
| 本文の言語 | 日本語（英語タイトルなし） |
| タイトル（和） | 時系列データを対象とする分位点探索のFPGA実装 |
| サブタイトル（和） | |
| タイトル（英） | |
| サブタイトル（英） | |
| キーワード(1)（和/英） | 分位点探索 / |
| キーワード(2)（和/英） | FPGA / |
| キーワード(3)（和/英） | 高位合成 / |
| キーワード(4)（和/英） | / |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 河内 陸 / / カワチ リク |
| 第1著者 所属（和/英） | 豊橋技術科学大学 (略称： 豊橋技科大) (略称： ) |
| 第2著者 氏名（和/英/ヨミ） | 佐藤 幸紀 / / |
| 第2著者 所属（和/英） | 豊橋技術科学大学 (略称： 豊橋技科大) (略称： ) |
| 講演者 | 第1著者 |
| 発表日時 | 2025-01-16 10:30:00 |
| 発表時間 | 25分 |
| 申込先研究会 | RECONF |
| 資料番号 | VLD2024-79, RECONF2024-109 |
| 巻番号（vol） | vol.124 |
| 号番号（no） | no.329(VLD), no.330(RECONF) |
| ページ範囲 | pp.18-22 |
| ページ数 | 5 |
| 発行日 | 2025-01-09 (VLD, RECONF) |
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