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講演抄録/キーワード
講演名 2025-01-16 16:10
量子誤り訂正むけFPGAクラスタのためのパケットアグリゲータの開発
佐方美月長名保範熊本大VLD2024-86 RECONF2024-116
抄録 (和) 多数の物理量子ビットで構成された符号によって形成される論理量子ビットに
よって、量子ビットのエラーを訂正しながら計算を行う誤り耐性型量子計算機
の研究が活発化しつつある。本研究グループでは、物理量子ビットとのインタ
フェイスとなる量子ビット制御装置と、誤り訂正符号を解くFPGAクラスタを接
続するインターコネクト技術について研究を行っている。現在の計画では両者を
10Gや100GのEthernetによって接続し、量子ビット制御装置で読み出したシン
ドローム情報を転送する構成であるが、システム規模によってはEthernetの帯
域幅が不足する可能性が明らかとなった。そこで、複数の量子ビット制御装置
からのEthernetフレームの情報をマージすることで帯域幅を節約するパケット
アグリゲータについて研究グループ内で議論がなされてきた。本研究報告では、
これを実現する基本的な機能についてVirtex UltraScale+ FPGA上に実装を行
い、動作確認を行った結果について、また動作確認のために開発したトラフィッ
クジェネレータ (量子フロントエンドエミュレータ) の構成についても述べる。
実装の結果、パケットアグリゲータはトラフィック量を数分の1に縮減にでき
るが、基本的な機能だけであれば非常に小さなリソースで実装することができ
ることが示された。本研究報告ではまた、これをもとに、インタコネクトをさ
らに高機能化・高性能化するためのデータ再分配システムなどについても議論
する。 
(英)
キーワード (和) FPGA / Ethernet / 量子誤り訂正 / 相互結合網 / トラフィック削減 / / /  
(英) / / / / / / /  
文献情報 信学技報, vol. 124, no. 330, RECONF2024-116, pp. 59-63, 2025年1月.
資料番号 RECONF2024-116 
発行日 2025-01-09 (VLD, RECONF) 
ISSN Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード VLD2024-86 RECONF2024-116

研究会情報
研究会 VLD RECONF  
開催期間 2025-01-16 - 2025-01-17 
開催地(和) キオクシア 横浜テクノロジーキャンパス Flagship棟 
開催地(英) Yokohama Technology Campus Flagship Building 
テーマ(和) FPGA 応用および一般 
テーマ(英) FPGA Applications, etc. 
講演論文情報の詳細
申込み研究会 RECONF 
会議コード 2025-01-VLD-RECONF 
本文の言語 日本語(英語タイトルなし) 
タイトル(和) 量子誤り訂正むけFPGAクラスタのためのパケットアグリゲータの開発 
サブタイトル(和)  
タイトル(英)  
サブタイトル(英)  
キーワード(1)(和/英) FPGA /  
キーワード(2)(和/英) Ethernet /  
キーワード(3)(和/英) 量子誤り訂正 /  
キーワード(4)(和/英) 相互結合網 /  
キーワード(5)(和/英) トラフィック削減 /  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 佐方 美月 / / サカタ ミヅキ
第1著者 所属(和/英) 熊本大学 (略称: 熊本大)
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第2著者 氏名(和/英/ヨミ) 長名 保範 / / オサナ ヤスノリ
第2著者 所属(和/英) 熊本大学 (略称: 熊本大)
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講演者 第1著者 
発表日時 2025-01-16 16:10:00 
発表時間 25分 
申込先研究会 RECONF 
資料番号 VLD2024-86, RECONF2024-116 
巻番号(vol) vol.124 
号番号(no) no.329(VLD), no.330(RECONF) 
ページ範囲 pp.59-63 
ページ数
発行日 2025-01-09 (VLD, RECONF) 


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