| 講演抄録/キーワード |
| 講演名 |
2025-12-02 16:15
2のべき乗拡張を用いたループ平坦化のアクセラレータ設計用コンパイラ上での実装と評価 ○出良 敦・瀬戸謙修(熊本大) VLD2025-38 ICD2025-58 DC2025-71 RECONF2025-89 |
| 抄録 |
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| キーワード |
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| 文献情報 |
信学技報, vol. 125, no. 260, VLD2025-38, pp. 111-116, 2025年12月. |
| 資料番号 |
VLD2025-38 |
| 発行日 |
2025-11-24 (VLD, ICD, DC, RECONF) |
| ISSN |
Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
| PDFダウンロード |
VLD2025-38 ICD2025-58 DC2025-71 RECONF2025-89 |
| 研究会情報 |
| 研究会 |
VLD DC RECONF ICD IPSJ-SLDM |
| 開催期間 |
2025-12-01 - 2025-12-03 |
| 開催地(和) |
富山国際会議場(富山) |
| 開催地(英) |
Toyama International Conference Center |
| テーマ(和) |
デザインガイア2025 -VLSI設計の新しい大地- |
| テーマ(英) |
Design Gaia 2025 -New Field of VLSI Design- |
| 講演論文情報の詳細 |
| 申込み研究会 |
VLD |
| 会議コード |
2025-12-VLD-DC-RECONF-ICD-SLDM |
| 本文の言語 |
日本語 |
| タイトル(和) |
2のべき乗拡張を用いたループ平坦化のアクセラレータ設計用コンパイラ上での実装と評価 |
| サブタイトル(和) |
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| タイトル(英) |
Implementation and evaluation of loop flattening with power-of-two extension in accelerator design tool |
| サブタイトル(英) |
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| 第1著者 氏名(和/英/ヨミ) |
出良 敦 / Atsushi Idera / イデラ アツシ |
| 第1著者 所属(和/英) |
熊本大学 (略称: 熊本大)
Kumamoto University (略称: Kumamoto University) |
| 第2著者 氏名(和/英/ヨミ) |
瀬戸 謙修 / Kenshu Seto / セト ケンシュウ |
| 第2著者 所属(和/英) |
熊本大学 (略称: 熊本大)
Kumamoto University (略称: Kumamoto University) |
| 第3著者 氏名(和/英/ヨミ) |
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| 講演者 |
第1著者 |
| 発表日時 |
2025-12-02 16:15:00 |
| 発表時間 |
20分 |
| 申込先研究会 |
VLD |
| 資料番号 |
VLD2025-38, ICD2025-58, DC2025-71, RECONF2025-89 |
| 巻番号(vol) |
vol.125 |
| 号番号(no) |
no.260(VLD), no.261(ICD), no.262(DC), no.263(RECONF) |
| ページ範囲 |
pp.111-116 |
| ページ数 |
6 |
| 発行日 |
2025-11-24 (VLD, ICD, DC, RECONF) |
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