| 講演抄録／キーワード |
| 講演名 |
2006-09-15 11:15
PERFORMANCE EVALUATION OF HARDWARE MULTI-PROCESS EXECUTION ON THE DYNAMICALLY RECONFIGURABLE PROCESSOR
○Vu Manh Tuan・Yohei Hasegawa・Naohiro Katsura・Hideharu Amano（Keio Univ.） |
| 抄録 |
（和） |
The hardware multi-process execution is a technique to enhance throughput by dividing reconfigurable devices into several pieces and concurrently execute several processes in the pipelined manner. The hardware multi-process execution on Dynamically Reconfigurable Processor (DRP), which is a coarse grain reconfigurable processor developed by NEC Electronics, is implemented and evaluated with real applications, which can be divided into two categories: a single task like DCT or Viterbi decoder, and multi tasks like a JPEG encoder. A total process for an application is divided into small processes and implemented on a limited area of PE array. Inter-process communication is done through the embedded FIFO. Through the evaluation, the overhead of this modification is not so influenced to the performance, cost and power consumption. When the pipelined execution works well, the throughput is improved almost double. |
| （英） |
The hardware multi-process execution is a technique to enhance throughput by dividing reconfigurable devices into several pieces and concurrently execute several processes in the pipelined manner. The hardware multi-process execution on Dynamically Reconfigurable Processor (DRP), which is a coarse grain reconfigurable processor developed by NEC Electronics, is implemented and evaluated with real applications, which can be divided into two categories: a single task like DCT or Viterbi decoder, and multi tasks like a JPEG encoder. A total process for an application is divided into small processes and implemented on a limited area of PE array. Inter-process communication is done through the embedded FIFO. Through the evaluation, the overhead of this modification is not so influenced to the performance, cost and power consumption. When the pipelined execution works well, the throughput is improved almost double. |
| キーワード |
（和） |
DRP / multi-process execution / single-process execution / performance / overhead / / / |
| （英） |
DRP / multi-process execution / single-process execution / performance / overhead / / / |
| 文献情報 |
信学技報, vol. 106, no. 247, RECONF2006-31, pp. 25-30, 2006年9月. |
| 資料番号 |
RECONF2006-31 |
| 発行日 |
2006-09-08 (RECONF) |
| ISSN |
Print edition: ISSN 0913-5685 |
| PDFダウンロード |
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| 研究会情報 |
| 研究会 |
RECONF |
| 開催期間 |
2006-09-14 - 2006-09-15 |
| 開催地（和） |
熊本大学 工学部百周年記念館 |
| 開催地（英） |
Kumamoto Univ. |
| テーマ（和） |
リコンフィギャラブルシステム，一般 |
| テーマ（英） |
Reconfigurable Systems, etc. |
| 講演論文情報の詳細 |
| 申込み研究会 |
RECONF |
| 会議コード |
2006-09-RECONF |
| 本文の言語 |
英語 |
| タイトル（和） |
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| サブタイトル（和） |
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| タイトル（英） |
PERFORMANCE EVALUATION OF HARDWARE MULTI-PROCESS EXECUTION ON THE DYNAMICALLY RECONFIGURABLE PROCESSOR |
| サブタイトル（英） |
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| キーワード(1)（和/英） |
DRP / DRP |
| キーワード(2)（和/英） |
multi-process execution / multi-process execution |
| キーワード(3)（和/英） |
single-process execution / single-process execution |
| キーワード(4)（和/英） |
performance / performance |
| キーワード(5)（和/英） |
overhead / overhead |
| キーワード(6)（和/英） |
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| キーワード(7)（和/英） |
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| キーワード(8)（和/英） |
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| 第1著者 氏名（和/英/ヨミ） |
Vu Manh Tuan / Vu Manh Tuan / |
| 第1著者 所属（和/英） |
Keio University (略称： 慶大)
Keio University (略称： Keio Univ.) |
| 第2著者 氏名（和/英/ヨミ） |
Yohei Hasegawa / Yohei Hasegawa / |
| 第2著者 所属（和/英） |
Keio University (略称： 慶大)
Keio University (略称： Keio Univ.) |
| 第3著者 氏名（和/英/ヨミ） |
Naohiro Katsura / Naohiro Katsura / |
| 第3著者 所属（和/英） |
Keio University (略称： 慶大)
Keio University (略称： Keio Univ.) |
| 第4著者 氏名（和/英/ヨミ） |
Hideharu Amano / Hideharu Amano / |
| 第4著者 所属（和/英） |
Keio University (略称： 慶大)
Keio University (略称： Keio Univ.) |
| 第5著者 氏名（和/英/ヨミ） |
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| 第6著者 氏名（和/英/ヨミ） |
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| 第7著者 氏名（和/英/ヨミ） |
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| 第8著者 氏名（和/英/ヨミ） |
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| 第36著者 氏名（和/英/ヨミ） |
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| 第36著者 所属（和/英） |
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| 講演者 |
第1著者 |
| 発表日時 |
2006-09-15 11:15:00 |
| 発表時間 |
30分 |
| 申込先研究会 |
RECONF |
| 資料番号 |
RECONF2006-31 |
| 巻番号（vol） |
vol.106 |
| 号番号（no） |
no.247 |
| ページ範囲 |
pp.25-30 |
| ページ数 |
6 |
| 発行日 |
2006-09-08 (RECONF) |
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