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講演抄録/キーワード
講演名 2007-05-10 14:55
SystemCを用いた動的再構成可能プロセッサのモデル開発
上田浩司・○北道淳司黒田研一会津大
抄録 (和) 近年, FPGA技術を応用した動的再構成可能プロセッサ(DRP)が提案されている.
DRPは独自の動的再構成可能アーキテクチャ(DRA)を持ち, 独自の設計自動化環境が
用意されている.
しかし, アプリケーションに特化した新規のDRAを含む動的再構成可能システム(DRS)の
システム設計において, 既存のDRP用記述言語およびCADでは対応できない可能性がある.
本稿では, システムレベルにおける汎用のDRSのモデリングのために開発し
ている動的モジュールライブラリを利用したDRPのシステムレベルモデリングについて述べる.
動的モジュールライブラリはSystemCの拡張ライブラリであり, モジュールの
動的な生成・削除およびポートの動的な接続・分断のモデリングが可能である.
提案プロセッサのアーキテクチャは, 基本となるMIPS型アーキテクチャに対して, 動的に生成・削除される演算器
のための命令およびそれらの生成・削除命令を追加したものである. 提案プロセッサのモデリングお
よびそのシミュレーション結果について述べる. 
(英) Recently, dynamically reconfigurable processors (DRPs) based on
FPGA technology are proposed.
DRPs are implemented on unique dynamically reconfigurable architecture,
and a specialized design environment is provided for the DRP.
In the case of the system design for new application specific
dynamically reconfigurable system ( DRS ), existing description language
and CAD system for existing DRA can not deal with this system design.
In this paper, we describe the system level modeling of a DRP using a
dynamic module library, which we have developed for the modeling of general
purpose DRSs at the system level.
The dynamic module library is an extended SystemC library, and enables
the modeling of the dynamically generation and elimination of modules, ports and channels
and the connection and dispatch between port and channel.
The architecture of proposed processor is based on a MIPS type architecture
and is appended
the instructions, which are for the dynamically reconfigurable operational units
and for the generation and elimination of them, and the hardware resources for the execution of appended instructions.
We describe the proposed DRP model and its simulation results.
キーワード (和) 動的再構成可能プロセッサ / SystemC / システムレベル / モデリング / / / /  
(英) Dynamically Reconfigurable Processor / SystemC / System Level / Modeling / / / /  
文献情報 信学技報, vol. 107, pp. 19-24, 2007年5月.
資料番号  
発行日 2007-05-03 (VLD) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
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研究会情報
研究会 VLD IPSJ-SLDM  
開催期間 2007-05-10 - 2007-05-11 
開催地(和) 京大会館 
開催地(英) Kyodai Kaikan 
テーマ(和) システム設計および一般 
テーマ(英) System Design, etc. 
講演論文情報の詳細
申込み研究会 IPSJ-SLDM 
会議コード 2007-05-VLD-IPSJ-SLDM 
本文の言語 日本語 
タイトル(和) SystemCを用いた動的再構成可能プロセッサのモデル開発 
サブタイトル(和)  
タイトル(英) A Modeling of Dynamically Reconfigurable Processor using SystemC 
サブタイトル(英)  
キーワード(1)(和/英) 動的再構成可能プロセッサ / Dynamically Reconfigurable Processor  
キーワード(2)(和/英) SystemC / SystemC  
キーワード(3)(和/英) システムレベル / System Level  
キーワード(4)(和/英) モデリング / Modeling  
キーワード(5)(和/英) /  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 上田 浩司 / Kouji Ueda / ウエダ コウジ
第1著者 所属(和/英) 会津大学 (略称: 会津大)
The University of Aidu (略称: The Univ. of Aidu)
第2著者 氏名(和/英/ヨミ) 北道 淳司 / Junji Kitamichi / キタミチ ジュンジ
第2著者 所属(和/英) 会津大学 (略称: 会津大)
The University of Aidu (略称: The Univ. of Aidu)
第3著者 氏名(和/英/ヨミ) 黒田 研一 / Kenichi Kuroda / クロダ ケンイチ
第3著者 所属(和/英) 会津大学 (略称: 会津大)
The University of Aidu (略称: The Univ. of Aidu)
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講演者 第2著者 
発表日時 2007-05-10 14:55:00 
発表時間 25分 
申込先研究会 IPSJ-SLDM 
資料番号 VLD2007-4 
巻番号(vol) vol.107 
号番号(no) no.31 
ページ範囲 pp.19-24 
ページ数
発行日 2007-05-03 (VLD) 


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