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| 講演抄録／キーワード | ||
| 講演名 | 2007-10-25 14:20 時間領域演算を用いたランクオーダフィルタおよびソーティングエンジンのコンパクトかつ低消費電力実装 ○グエン タンリム・伊藤潔人・柴田 直（東大）  SIP2007-117 ICD2007-106 IE2007-76 エレソ技報アーカイブへのリンク：ICD2007-106 |
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| 抄録 | （和） | (まだ登録されていません) |
| （英） | A compact and power-efficient digital implementation of rank order filters compatible with focal-plane image processing has been developed based on a time-domain computation technique. The magnitude of an analog pixel intensity is represented as a pulse width in the pulse width modulation scheme and the rank order filtering is accomplished using simple digital adders and a binary counter. As a result, a very compact implementation comparable to analog counterparts has been achieved, while preserving the accuracy and programmability of digital implementation, this enable us to use the rank order filter as a building block in a parallel processing array. A test chip capable of performing multiple rank order filtering for up to 16 inputs was designed and fabricated in a 0.35-m standard CMOS technology. Experimental results have demonstrated the correct operation of the circuit in a low power dissipation (0.44mW at 3.3V) with a very compact core size (0.014mm2). The circuit has shown the speed performance of over 260K ranks/s at 8-bit resolution, which is more than sufficient for use at typical video frame rates. In addition, a new architecture for compact implementation of sorting engines with some modification in peripheral circuitries of the proposed rank order filtering architecture is also presented. | |
| キーワード | （和） | ランクオーダフィルタ / ROF / メディアンフィルタ / 最短距離探索 / WTA / ソーティング / ハードウエア実装 / 並列処理 |
| （英） | rank order filter / ROF / median filter / winner-take-all / WTA / sorting / hardware implementation / parallel processing | |
| 文献情報 | 信学技報, vol. 107, no. 287, ICD2007-106, pp. 41-46, 2007年10月. | |
| 資料番号 | ICD2007-106 | |
| 発行日 | 2007-10-18 (SIP, ICD, IE) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | SIP2007-117 ICD2007-106 IE2007-76 エレソ技報アーカイブへのリンク：ICD2007-106 |
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| 研究会情報 | |
| 研究会 | SIP ICD IE IPSJ-SLDM |
| 開催期間 | 2007-10-25 - 2007-10-26 |
| 開催地（和） | 会津東山温泉 くつろぎ宿(福島) 新滝別館（新しい建物）4階コンベンションホール |
| 開催地（英） | Aidu-Higasiyama-Onsen Kuturogijuku |
| テーマ（和） | システムLSIの応用と要素技術、専用プロセッサ、プロセッサ、DSP、画像処理技術および一般 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | ICD |
| 会議コード | 2007-10-SIP-ICD-IE-IPSJ-SLDM |
| 本文の言語 | 英語（日本語タイトルあり） |
| タイトル（和） | 時間領域演算を用いたランクオーダフィルタおよびソーティングエンジンのコンパクトかつ低消費電力実装 |
| サブタイトル（和） | |
| タイトル（英） | New Compact and Power-Efficient Implementations of Rank-Order-Filters and Sorting Engines Using Time-Domain Technique |
| サブタイトル（英） | |
| キーワード(1)（和/英） | ランクオーダフィルタ / rank order filter |
| キーワード(2)（和/英） | ROF / ROF |
| キーワード(3)（和/英） | メディアンフィルタ / median filter |
| キーワード(4)（和/英） | 最短距離探索 / winner-take-all |
| キーワード(5)（和/英） | WTA / WTA |
| キーワード(6)（和/英） | ソーティング / sorting |
| キーワード(7)（和/英） | ハードウエア実装 / hardware implementation |
| キーワード(8)（和/英） | 並列処理 / parallel processing |
| 第1著者 氏名（和/英/ヨミ） | グエン タンリム / Liem T. Nguyen / グエン タンリム |
| 第1著者 所属（和/英） | 東京大学 (略称： 東大) University of Tokyo (略称： Univ. of Tokyo) |
| 第2著者 氏名（和/英/ヨミ） | 伊藤 潔人 / Kiyoto Ito / イトウ キヨト |
| 第2著者 所属（和/英） | 東京大学 (略称： 東大) University of Tokyo (略称： Univ. of Tokyo) |
| 第3著者 氏名（和/英/ヨミ） | 柴田 直 / Tadashi Shibata / シバタ タダシ |
| 第3著者 所属（和/英） | 東京大学 (略称： 東大) University of Tokyo (略称： Univ. of Tokyo) |
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| 講演者 | 第1著者 |
| 発表日時 | 2007-10-25 14:20:00 |
| 発表時間 | 20分 |
| 申込先研究会 | ICD |
| 資料番号 | SIP2007-117, ICD2007-106, IE2007-76 |
| 巻番号（vol） | vol.107 |
| 号番号（no） | no.285(SIP), no.287(ICD), no.289(IE) |
| ページ範囲 | pp.41-46 |
| ページ数 | 6 |
| 発行日 | 2007-10-18 (SIP, ICD, IE) |
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