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| 講演抄録／キーワード | ||
| 講演名 | 2010-01-27 13:30 並列ブランチング・プログラム・マシンを用いたパケット分類器について ○中原啓貴・笹尾 勤・松浦宗寛（九工大）・川村嘉郁（ルネサステクノロジ）  VLD2009-92 CPSY2009-74 RECONF2009-77 |
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| 抄録 | （和） | ブランチング・プログラム・マシン~(BM)とは 2種類の命令~(分岐命令と出力命令)を有するプロセッサであり, 汎用プロセッサよりもアーキテクチャが単純である. BMは条件分岐を専用命令で実行するので, 特定のアプリケーションに対して汎用プロセッサよりも高速に処理できる. 本論文では, パケット分類器を並列ブランチング・プログラム・マシン~(PBM)を用いて実現する. パケット分類器のルールの集合を分割し, 複数のBMで並列に処理する. ルール数が与えられたとき, 所定の性能を出すために必要なBMの台数を推定できることを示す. BMを32台用いたPBM32をFPGA上に実装し, Intel社のCore2Duo@1.2GHzと 比較を行った結果, PBM32は最長実行時間に関して Core2Duoよりも8.1～11.1倍高速であり, メモリ量に関して9.7～436.2分の1であった. |
| （英） | A branching program machine~(BM) is a special-purpose processor that uses only two kinds of instructions: Branch and output instructions. Thus, the architecture for the BM is much simpler than that for a general-purpose microprocessor~(MPU). Since the BM uses the dedicated instructions for a special-purpose application, it is faster than the MPU. This paper presents a packet filter using a parallel BMs~(PBM). To reduce computation time and code size, first, a set of rules for packet filter is partitioned into subsets. Then, the PBM evaluates them in parallel. Also, the paper shows a method to estimate the necessary number of BMs to realize a given packet filter. We implemented the PBM32, a system using 32 BMs, on an FPGA, and compared it with the Intel's Core2Duo@1.2GHz microprocessor. The PBM32 is 8.1-11.1 times faster than the Core2Duo, and the PBM32 requries only 0.2-10.3 percent of the memory for the Core2Duo. |
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| キーワード | （和） | ブランチングプログラムマシン / パケット分類 / 組込みシステム / BDD / QDD / / / |
| （英） | Branching Program Machine / Packet Classifier / Embedded System / BDD / QDD / / / | |
| 文献情報 | 信学技報, vol. 109, no. 395, RECONF2009-77, pp. 143-148, 2010年1月. | |
| 資料番号 | RECONF2009-77 | |
| 発行日 | 2010-01-19 (VLD, CPSY, RECONF) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2009-92 CPSY2009-74 RECONF2009-77 |
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| 研究会情報 | |
| 研究会 | IPSJ-SLDM VLD CPSY RECONF |
| 開催期間 | 2010-01-26 - 2010-01-27 |
| 開催地（和） | 慶應義塾大学日吉キャンパス |
| 開催地（英） | Keio Univ (Hiyoshi Campus) |
| テーマ（和） | FPGA応用および一般 |
| テーマ（英） | FPGA Applications, etc |
| 講演論文情報の詳細 | |
| 申込み研究会 | RECONF |
| 会議コード | 2010-01-SLDM-VLD-CPSY-RECONF |
| 本文の言語 | 日本語 |
| タイトル（和） | 並列ブランチング・プログラム・マシンを用いたパケット分類器について |
| サブタイトル（和） | |
| タイトル（英） | A Packet Classifier Using a Parallel Branching Program Machine |
| サブタイトル（英） | |
| キーワード(1)（和/英） | ブランチングプログラムマシン / Branching Program Machine |
| キーワード(2)（和/英） | パケット分類 / Packet Classifier |
| キーワード(3)（和/英） | 組込みシステム / Embedded System |
| キーワード(4)（和/英） | BDD / BDD |
| キーワード(5)（和/英） | QDD / QDD |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 中原 啓貴 / Hiroki Nakahara / ナカハラ ヒロキ |
| 第1著者 所属（和/英） | 九州工業大学 (略称： 九工大) Kyushu Institute of Technology (略称： Kyushu Inst. of Tech.) |
| 第2著者 氏名（和/英/ヨミ） | 笹尾 勤 / Tsutomu Sasao / ササオ ツトム |
| 第2著者 所属（和/英） | 九州工業大学 (略称： 九工大) Kyushu Institute of Technology (略称： Kyushu Inst. of Tech.) |
| 第3著者 氏名（和/英/ヨミ） | 松浦 宗寛 / Munehiro Matsuura / マツウラ ムネヒロ |
| 第3著者 所属（和/英） | 九州工業大学 (略称： 九工大) Kyushu Institute of Technology (略称： Kyushu Inst. of Tech.) |
| 第4著者 氏名（和/英/ヨミ） | 川村 嘉郁 / Yoshifumi Kawamura / カワムラ ヨシフミ |
| 第4著者 所属（和/英） | ルネサステクノロジ (略称： ルネサステクノロジ) Renesas Technology Corporation. (略称： Renesas Tech Corp.) |
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| 講演者 | 第1著者 |
| 発表日時 | 2010-01-27 13:30:00 |
| 発表時間 | 25分 |
| 申込先研究会 | RECONF |
| 資料番号 | VLD2009-92, CPSY2009-74, RECONF2009-77 |
| 巻番号（vol） | vol.109 |
| 号番号（no） | no.393(VLD), no.394(CPSY), no.395(RECONF) |
| ページ範囲 | pp.143-148 |
| ページ数 | 6 |
| 発行日 | 2010-01-19 (VLD, CPSY, RECONF) |
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