講演抄録/キーワード |
講演名 |
2010-03-11 11:15
潜在的多様性を考慮したプログラマブルハードウェアの高位合成手法 ○吉田浩章・藤田昌宏(東大/JST) VLD2009-110 |
抄録 |
(和) |
SoCの開発コスト増大と開発期間短縮に伴い,製造故障や設計誤りの製造後修正を可能とする技術の重要性が増している.最近になり,制御部分をプログラマブルにすることにより製造後修正を可能とするプログラマブルハードウェアアクセラレータが注目されている.既存設計手法では初期設計に最適化されたデータパスとプログラマブル制御回路を合成するため,修正後の性能については考慮していない.本稿では,製造後に起こりうる潜在的な設計修正後の性能歩留まりを最大化するようなプログラマブルハードウェアの合成手法を提案する.例題を用いた計算機実験により,小さい面積オーバーヘッドで性能歩留まりを大幅に向上可能であることを示した. |
(英) |
Recently, programmable hardware accelerators have attracted more attention as an enabling solution for post-silicon engineering change, manufacturing defect tolerance, and efficient hardware reuse. Since existing techniques synthesize for a specific application, the synthesized hardware may not satisfy the performance goal under potential varieties such as engineering changes and manufacturing defects. This paper proposes a synthesis methodology of programmable hardware accelerators which maximizes the performance yield under potential varieties. Experimental results demonstrate that our methodology can improve the performance yield significantly with a small area increase. |
キーワード |
(和) |
プログラマブルハードウェア / 製造後修正 / 高位合成 / 性能歩留まり / / / / |
(英) |
Programmable hardware accelerators / engineering changes / high-level synthesis / performance yield / / / / |
文献情報 |
信学技報, vol. 109, no. 462, VLD2009-110, pp. 67-72, 2010年3月. |
資料番号 |
VLD2009-110 |
発行日 |
2010-03-03 (VLD) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
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VLD2009-110 |