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| 講演抄録／キーワード | ||
| 講演名 | 2013-01-17 13:25 A Channel-based Communication/Synchronization Model for SW-HW Multitasking on Dynamically Partially Reconfigurable FPGAs ○Krzysztof Jozwik・Shinya Honda・Masato Edahiro（Nagoya Univ.）・Hiroyuki Tomiyama（Ritsumeikan Univ.）・Hiroaki Takada（Nagoya Univ.）  VLD2012-130 CPSY2012-79 RECONF2012-84 |
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| 抄録 | （和） | Dynamically Partially Reconfigurable (DPR) FPGAs allow for implementation of a concept of SW-HW multitasking where flow of execution run on CPU and reconfigurable hardware. This paper presents a channel-based communication model tailored for such systems. The channels are abstract objects with unique and statically assigned IDs, passed as a parameter to channel access API calls. Physically, they are divided into master and slave parts located either in SW or dynamically reconfigured with the HW task, which allows for point-to-point inter-task communication, its optimizations between a given pair of tasks and decreases the overall logic utilization in the system. |
| （英） | Dynamically Partially Reconfigurable (DPR) FPGAs allow for implementation of a concept of SW-HW multitasking where flow of execution run on CPU and reconfigurable hardware. This paper presents a channel-based communication model tailored for such systems. The channels are abstract objects with unique and statically assigned IDs, passed as a parameter to channel access API calls. Physically, they are divided into master and slave parts located either in SW or dynamically reconfigured with the HW task, which allows for point-to-point inter-task communication, its optimizations between a given pair of tasks and decreases the overall logic utilization in the system. |
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| キーワード | （和） | SW-HW Multitasking / Dynamic Reconfiguration / Runtime Reconfiguration / FPGA / / / / |
| （英） | SW-HW Multitasking / Dynamic Reconfiguration / Runtime Reconfiguration / FPGA / / / / | |
| 文献情報 | 信学技報, vol. 112, no. 377, RECONF2012-84, pp. 135-140, 2013年1月. | |
| 資料番号 | RECONF2012-84 | |
| 発行日 | 2013-01-09 (VLD, CPSY, RECONF) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2012-130 CPSY2012-79 RECONF2012-84 |
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| 研究会情報 | |
| 研究会 | CPSY VLD RECONF IPSJ-SLDM |
| 開催期間 | 2013-01-16 - 2013-01-17 |
| 開催地（和） | 慶応義塾大学 日吉キャンパス |
| 開催地（英） | |
| テーマ（和） | FPGA応用および一般 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | RECONF |
| 会議コード | 2013-01-CPSY-VLD-RECONF-SLDM |
| 本文の言語 | 英語 |
| タイトル（和） | |
| サブタイトル（和） | |
| タイトル（英） | A Channel-based Communication/Synchronization Model for SW-HW Multitasking on Dynamically Partially Reconfigurable FPGAs |
| サブタイトル（英） | |
| キーワード(1)（和/英） | SW-HW Multitasking / SW-HW Multitasking |
| キーワード(2)（和/英） | Dynamic Reconfiguration / Dynamic Reconfiguration |
| キーワード(3)（和/英） | Runtime Reconfiguration / Runtime Reconfiguration |
| キーワード(4)（和/英） | FPGA / FPGA |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | Krzysztof Jozwik / Krzysztof Jozwik / |
| 第1著者 所属（和/英） | Nagoya University (略称： 名大) Nagoya University (略称： Nagoya Univ.) |
| 第2著者 氏名（和/英/ヨミ） | Shinya Honda / Shinya Honda / |
| 第2著者 所属（和/英） | Nagoya University (略称： 名大) Nagoya University (略称： Nagoya Univ.) |
| 第3著者 氏名（和/英/ヨミ） | Masato Edahiro / Masato Edahiro / |
| 第3著者 所属（和/英） | Nagoya University (略称： 名大) Nagoya University (略称： Nagoya Univ.) |
| 第4著者 氏名（和/英/ヨミ） | Hiroyuki Tomiyama / Hiroyuki Tomiyama / |
| 第4著者 所属（和/英） | Ritsumeikan University (略称： 立命館大) Ritsumeikan University (略称： Ritsumeikan Univ.) |
| 第5著者 氏名（和/英/ヨミ） | Hiroaki Takada / Hiroaki Takada / |
| 第5著者 所属（和/英） | Nagoya University (略称： 名大) Nagoya University (略称： Nagoya Univ.) |
| 講演者 | 第1著者 |
| 発表日時 | 2013-01-17 13:25:00 |
| 発表時間 | 25分 |
| 申込先研究会 | RECONF |
| 資料番号 | VLD2012-130, CPSY2012-79, RECONF2012-84 |
| 巻番号（vol） | vol.112 |
| 号番号（no） | no.375(VLD), no.376(CPSY), no.377(RECONF) |
| ページ範囲 | pp.135-140 |
| ページ数 | 6 |
| 発行日 | 2013-01-09 (VLD, CPSY, RECONF) |
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