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| 講演抄録／キーワード | ||
| 講演名 | 2013-01-31 10:45 実時間前景分離FPGAの実装に関する一検討 ○梶本智仁・八木 竜・西谷隆夫（首都大東京）  SIP2012-83 RCS2012-240 |
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| 抄録 | （和） | 本研究では，Walsh変換多重解像度混合ガウス分布（GMM）前景分離の多重解像度Walsh変換プロセッサの，FPGA を用いた試作とその評価を行う．空間処理である多重解像度Walsh 変換は，密結合プログラマブルマルチプロセッサ，時間処理であるGMM 前景分離はスレッド型プログラマブルマルチプロセッサとして実装を行う．今回報告するのはこの中の密結合プロセッサのアーキテクチャであり，演算量削減と内部メモリの排除を行ったストリーミングアプローチの詳細設計である．設計したプロセッサは30fps のHDTV サイズの映像を対象とし，100MHz クロックで実時間処理ができる． |
| （英） | A prototype processor based on the multi-resolution GMM Foreground Segmentation algorithm by using Walsh Transform domain is implemented by a FPGA chip. The spatial processing of the Walsh transform is realized by using a tightly coupled programmable multi-processor and the temporal processing of GMM Foreground Segmentation is realized by using a multi-thread programmable processor. In this paper, a tightly coupled Walsh transform feature generation processing is described which employs a streaming processing approach. The implemented processor can achieve real time processing of an HDTV video sequence of 30fps by 100MHz clocks. |
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| キーワード | （和） | Walsh変換 / 前景分離 / FPGA / IPコア / プログラマブルプロセッサ / / / |
| （英） | Walsh Transform / Foreground Segmentation / FPGA / IP-CORE / Programmable Processor / / / | |
| 文献情報 | 信学技報, vol. 112, no. 423, SIP2012-83, pp. 13-18, 2013年1月. | |
| 資料番号 | SIP2012-83 | |
| 発行日 | 2013-01-24 (SIP, RCS) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | SIP2012-83 RCS2012-240 |
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| 研究会情報 | |
| 研究会 | SIP RCS |
| 開催期間 | 2013-01-31 - 2013-02-01 |
| 開催地（和） | ビューポートくれ（呉） |
| 開催地（英） | Viewport-Kure-Hotel (Kure) |
| テーマ（和） | 無線通信のための信号処理および一般 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | SIP |
| 会議コード | 2013-01-SIP-RCS |
| 本文の言語 | 日本語 |
| タイトル（和） | 実時間前景分離FPGAの実装に関する一検討 |
| サブタイトル（和） | |
| タイトル（英） | A study on a FPGA implementation of real time foreground segmentation |
| サブタイトル（英） | |
| キーワード(1)（和/英） | Walsh変換 / Walsh Transform |
| キーワード(2)（和/英） | 前景分離 / Foreground Segmentation |
| キーワード(3)（和/英） | FPGA / FPGA |
| キーワード(4)（和/英） | IPコア / IP-CORE |
| キーワード(5)（和/英） | プログラマブルプロセッサ / Programmable Processor |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 梶本 智仁 / Tomohito Kajimoto / カジモト トモヒト |
| 第1著者 所属（和/英） | 首都大学東京 (略称： 首都大東京) Tokyo Metropolitan University (略称： Tokyo Metropolitan Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 八木 竜 / Ryo Yagi / ヤギ リョウ |
| 第2著者 所属（和/英） | 首都大学東京 (略称： 首都大東京) Tokyo Metropolitan University (略称： Tokyo Metropolitan Univ.) |
| 第3著者 氏名（和/英/ヨミ） | 西谷 隆夫 / Takao Nishitani / ニシタニ タカオ |
| 第3著者 所属（和/英） | 首都大学東京 (略称： 首都大東京) Tokyo Metropolitan University (略称： Tokyo Metropolitan Univ.) |
| 講演者 | 第1著者 |
| 発表日時 | 2013-01-31 10:45:00 |
| 発表時間 | 25分 |
| 申込先研究会 | SIP |
| 資料番号 | SIP2012-83, RCS2012-240 |
| 巻番号（vol） | vol.112 |
| 号番号（no） | no.423(SIP), no.424(RCS) |
| ページ範囲 | pp.13-18 |
| ページ数 | 6 |
| 発行日 | 2013-01-24 (SIP, RCS) |
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