講演抄録/キーワード |
講演名 |
2013-06-13 14:55
スケーラブルDVCにおける変換量子化回路のVLSI設計 ○田中鳴海・岡田雅司(阪大)・迫水和仁(阪大/OKI)・尾上孝雄(阪大) SIS2013-8 |
抄録 |
(和) |
本研究ではDistributed Video Codingエンコーダの組込みシステムの実現を目指しており,最も支配的な演算量を占める変換量子化部のハードウェア化に向けたアーキテクチャの検討と実装を行う.本論文で提案するアーキテクチャでは,変換量子化部における画素毎の独立した処理を並列実装することで処理の高速化を図り,演算の一部をハードウェアに適した等価な演算に置き換えることで回路規模の削減を行なっている.提案アーキテクチャはVerilog HDLを用いて実装しており,その結果,解像度1920×1080画素,30fpsの動画において実時間処理が可能であることを示した. |
(英) |
In this research, we aim to realize an embedded system for distributed video coding (DVC) encoder. Since transform and quantization processes of DVC encoding are the most dominant, we discuss architecture for its hardware implementation. In the proposed architecture, the transform and quantization processes are implemented in parallel by processing multiple pixels simultaneously, and the resource utilization is reduced by replacing equations used in DVC encoding with equivalent ones, which are suitable for hardware implementation. We implemented our architecture with Verilog HDL and evaluated it. In the experimental result, our hardware implementation achieved 30 fps encoding performance for $1920times1080$ resolution videos. |
キーワード |
(和) |
Distributed Video Coding / 変換 / 量子化 / VLSI アーキテクチャ / / / / |
(英) |
Distributed Video Coding / transform / quantization / VLSI architecture / / / / |
文献情報 |
信学技報, vol. 113, no. 78, SIS2013-8, pp. 39-44, 2013年6月. |
資料番号 |
SIS2013-8 |
発行日 |
2013-06-06 (SIS) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
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SIS2013-8 |