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| 講演抄録／キーワード | ||
| 講演名 | 2013-10-07 16:05 3×倍速実時間6万語彙連続音声認識のための40-nm, 54-mW音声認識専用プロセッサ ○何 光霽・宮本優貴・松田薫平・和泉慎太郎・川口 博・吉本雅彦（神戸大）  VLD2013-52 ICD2013-76 IE2013-52 |
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| 抄録 | （和） | 本稿では，6万語彙の実時間連続音声認識のための低消費電力VLSIチップについて説明する．高速，高精度，低消費電力で6万語彙連続音声認識を実現するために，以前試作した音声認識プロセッサの提案手法を用いた上で，高並列な8-pass Viterbi遷移アーキテクチャを実装することで，全体処理速度のネックとなっているViterbi部分をさらに高速化させた．また，探索処理において第2パスにtri-gramを用いることで，認識精度をbi-gramのみの場合より約2%向上できた． 回路規模2.98MTr，オンチップ SRAM容量4.29Mbitsの6万語彙連続音声認識のための専用プロセッサを設計し，40nmプロセスで試作した． bi-gramのみを使う場合，実時間処理に必要な62.5MHz動作時の消費電力は54.8 mWであった．標準電圧(1.1V)で最大200MHz (177.4 mW) 動作が確認され， 3倍速動作を実現できた．また，tri-gramを使う場合，200MHzで最高処理速度は2.25倍速であり，消費電力は174.56 mWであった． |
| （英） | This paper describes a low-power VLSI chip for speaker-independent 60-kWord continuous speech recognition based on a context-dependent Hidden Markov Model (HMM). We implement parallel and pipelined architecture for GMM computation and Viterbi processing. It includes a 8-path Viterbi transition architecture to maximize the processing speed and adopts tri-gram language model to improve the recognition accuracy. A two-level cache architecture is implemented for the demo system. The test chip, fabricated in 40 nm CMOS technology, occupies 1.77 mm × 2.18 mm containing 2.98 M transistors for logic and 4.29 Mbit on-chip memory. The measured results show that our implementation achieves 25% required frequency reduction (62.5 MHz) and 26% power consumption reduction (54.8 mW) for 60 k-Word real-time continuous speech recognition compared to the previous work. This chip can maximally process 3.02× and 2.25× times faster than real-time at 200 MHz using the bigram and trigram language models, respectively. | |
| キーワード | （和） | 40nm VLSI / 隠れマルコフモデル(HMM) / 大語彙連続音声認識システム(LVCSR) / / / / / |
| （英） | 40nm VLSI / Hidden Markov Model (HMM) / large vocabulary continuous speech recognition (LVCSR) / / / / / | |
| 文献情報 | 信学技報, vol. 113, no. 236, ICD2013-76, pp. 29-34, 2013年10月. | |
| 資料番号 | ICD2013-76 | |
| 発行日 | 2013-09-30 (VLD, ICD, IE) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2013-52 ICD2013-76 IE2013-52 |
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| 研究会情報 | |
| 研究会 | IE ICD VLD IPSJ-SLDM |
| 開催期間 | 2013-10-07 - 2013-10-08 |
| 開催地（和） | 弘前大学 コラボ弘大 |
| 開催地（英） | |
| テーマ（和） | システムLSIの応用とその要素技術，専用プロセッサ，プロセッサ，DSP，画像処理技術，および一般 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | ICD |
| 会議コード | 2013-10-IE-ICD-VLD-SLDM |
| 本文の言語 | 日本語 |
| タイトル（和） | 3×倍速実時間6万語彙連続音声認識のための40-nm, 54-mW音声認識専用プロセッサ |
| サブタイトル（和） | |
| タイトル（英） | A 2.4x-Real-Time VLSI Processor for 60-kWord Continuous Speech Recognition |
| サブタイトル（英） | |
| キーワード(1)（和/英） | 40nm VLSI / 40nm VLSI |
| キーワード(2)（和/英） | 隠れマルコフモデル(HMM) / Hidden Markov Model (HMM) |
| キーワード(3)（和/英） | 大語彙連続音声認識システム(LVCSR) / large vocabulary continuous speech recognition (LVCSR) |
| キーワード(4)（和/英） | / |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 何 光霽 / Guangji He / カ コウサイ |
| 第1著者 所属（和/英） | 神戸大学 (略称： 神戸大) Kobe University (略称： Kobe Univ) |
| 第2著者 氏名（和/英/ヨミ） | 宮本 優貴 / Yuki Miyamoto / ミヤモト ユキ |
| 第2著者 所属（和/英） | 神戸大学 (略称： 神戸大) Kobe University (略称： Kobe Univ) |
| 第3著者 氏名（和/英/ヨミ） | 松田 薫平 / Kumpei Matsuda / マツダ クンペイ |
| 第3著者 所属（和/英） | 神戸大学 (略称： 神戸大) Kobe University (略称： Kobe Univ) |
| 第4著者 氏名（和/英/ヨミ） | 和泉 慎太郎 / Shintaro Izumi / ワイズミ シンタロウ |
| 第4著者 所属（和/英） | 神戸大学 (略称： 神戸大) Kobe University (略称： Kobe Univ) |
| 第5著者 氏名（和/英/ヨミ） | 川口 博 / Hiroshi Kawaguchi / カワグチ ヒロシ |
| 第5著者 所属（和/英） | 神戸大学 (略称： 神戸大) Kobe University (略称： Kobe Univ) |
| 第6著者 氏名（和/英/ヨミ） | 吉本 雅彦 / Masahiko Yoshimoto / ヨシモト マサヒコ |
| 第6著者 所属（和/英） | 神戸大学 (略称： 神戸大) Kobe University (略称： Kobe Univ) |
| 講演者 | 第1著者 |
| 発表日時 | 2013-10-07 16:05:00 |
| 発表時間 | 25分 |
| 申込先研究会 | ICD |
| 資料番号 | VLD2013-52, ICD2013-76, IE2013-52 |
| 巻番号（vol） | vol.113 |
| 号番号（no） | no.235(VLD), no.236(ICD), no.237(IE) |
| ページ範囲 | pp.29-34 |
| ページ数 | 6 |
| 発行日 | 2013-09-30 (VLD, ICD, IE) |
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