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| 講演抄録／キーワード | ||
| 講演名 | 2015-06-20 09:55 A Near-memory Processing Architecture on FPGAs for Data Movement Intensive Applications ○Vu Hoang Gia・Tran Thi Hong・Shinya Takamaeda・Yasuhiko Nakashima（NAIST）  RECONF2015-15 |
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| 抄録 | （和） | (まだ登録されていません) |
| （英） | Memory latency is the most serious design concern in computing centric architectures integrated with cache levels as a deep memory hierarchy. This latency directly decreases the computing speed while increases the energy consumption of such system in total. The impact is even more critical in intensive-data-movement applications, in which memory access completely dominates data processing in computing engines. To alleviate such latency, we propose an architecture which allows some computing functions to be executed near the memory. This architecture is also expected to exploit the advantages of non-cached computing models while able to combine with cached computing engines. | |
| キーワード | （和） | / / / / / / / |
| （英） | Near data processing / near memory / near DRAM / memory latency / memory hierarchy / cache hierarchy / / | |
| 文献情報 | 信学技報, vol. 115, no. 109, RECONF2015-15, pp. 79-84, 2015年6月. | |
| 資料番号 | RECONF2015-15 | |
| 発行日 | 2015-06-12 (RECONF) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| 査読に ついて |
本技術報告は査読を経ていない技術報告であり，推敲を加えられていずれかの場に発表されることがあります． | |
| PDFダウンロード | RECONF2015-15 |
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| 研究会情報 | |
| 研究会 | RECONF |
| 開催期間 | 2015-06-19 - 2015-06-20 |
| 開催地（和） | 京都大学 |
| 開催地（英） | Kyoto University |
| テーマ（和） | 「十周年記念研究会」 リコンフィギャラブルシステム、一般 |
| テーマ（英） | the 10th anniversary celebration of RECONF: Reconfigurable Systems, etc. |
| 講演論文情報の詳細 | |
| 申込み研究会 | RECONF |
| 会議コード | 2015-06-RECONF |
| 本文の言語 | 英語 |
| タイトル（和） | |
| サブタイトル（和） | |
| タイトル（英） | A Near-memory Processing Architecture on FPGAs for Data Movement Intensive Applications |
| サブタイトル（英） | |
| キーワード(1)（和/英） | / Near data processing |
| キーワード(2)（和/英） | / near memory |
| キーワード(3)（和/英） | / near DRAM |
| キーワード(4)（和/英） | / memory latency |
| キーワード(5)（和/英） | / memory hierarchy |
| キーワード(6)（和/英） | / cache hierarchy |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | Vu Hoang Gia / Vu Hoang Gia / |
| 第1著者 所属（和/英） | Nara Institute of Science and Technology (略称： 奈良先端大) Nara Institute of Science and Technology (略称： NAIST) |
| 第2著者 氏名（和/英/ヨミ） | Tran Thi Hong / Tran Thi Hong / |
| 第2著者 所属（和/英） | Nara Institute of Science and Technology (略称： 奈良先端大) Nara Institute of Science and Technology (略称： NAIST) |
| 第3著者 氏名（和/英/ヨミ） | 高前田 伸也 / Shinya Takamaeda / タカマエダ シンヤ |
| 第3著者 所属（和/英） | Nara Institute of Science and Technology (略称： 奈良先端大) Nara Institute of Science and Technology (略称： NAIST) |
| 第4著者 氏名（和/英/ヨミ） | 中島 康彦 / Yasuhiko Nakashima / ナカシマ ヤスヒコ |
| 第4著者 所属（和/英） | Nara Institute of Science and Technology (略称： 奈良先端大) Nara Institute of Science and Technology (略称： NAIST) |
| 第5著者 氏名（和/英/ヨミ） | / / |
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| 第6著者 氏名（和/英/ヨミ） | / / |
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| 第18著者 所属（和/英） | (略称： ) (略称： ) |
| 講演者 | 第1著者 |
| 発表日時 | 2015-06-20 09:55:00 |
| 発表時間 | 25分 |
| 申込先研究会 | RECONF |
| 資料番号 | RECONF2015-15 |
| 巻番号（vol） | vol.115 |
| 号番号（no） | no.109 |
| ページ範囲 | pp.79-84 |
| ページ数 | 6 |
| 発行日 | 2015-06-12 (RECONF) |
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