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講演抄録/キーワード
講演名 2021-01-29 13:40
チャージポンプの入力電圧源の切り替えによる小面積化および段数可変による効率改善
廣永駿輔佐藤隆英小川覚美山梨大CAS2020-64 ICTSSL2020-49
抄録 (和) 電流経路に存在するスイッチが1個のみである広い入出力電圧範囲を有する昇降圧型電源回路を開発する.本稿では,この電源回路の制御回路に電力を供給する補助電源であるチャージポンプについて論ずる.電源回路の起動時と定常動作時でチャージポンプの入力電圧源の切り替えを行うことでチャージポンプの段数削減を行っている.この制御によってチャージポンプに持ちうる素子が占めるチップ面積を5 %削減することが可能となる.また,入力電圧の大きさに応じてチャージポンプの段数を可変することで効率の改善している.提案するチャージポンプの動作はシミュレーションによって確認しており,効率は最大で5.3 %改善する. 
(英) A step-up/step-down power supply circuit with a wide input/output voltage range, which has only one switch in its current path, is developed. In this paper, we propose a novel control of a charge pump which is used for an auxiliary power supply of a control circuit for the power supply circuit. The number of stages of the charge pump is reduced by switching the input voltage source when the power supply circuit starts up. In addition, the efficiency of the charge pump is improved by varying the number of stages depending on the input voltage. The efficiency of the charge pump has been confirmed by a simulation. The simulation results show that the efficiency is improved by up to 5.3 %.
キーワード (和) 電源回路 / チャージポンプ / 効率改善 / 省チップ専有面積 / / / /  
(英) Power supply circuit / Charge Pump / Improving efficiency / Reducing chip area / / / /  
文献情報 信学技報, vol. 120, no. 346, CAS2020-64, pp. 130-135, 2021年1月.
資料番号 CAS2020-64 
発行日 2021-01-21 (CAS, ICTSSL) 
ISSN Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード CAS2020-64 ICTSSL2020-49

研究会情報
研究会 CAS ICTSSL  
開催期間 2021-01-28 - 2021-01-29 
開催地(和) オンライン開催 
開催地(英) Online 
テーマ(和) 学生セッション,一般 
テーマ(英) Students session, General session 
講演論文情報の詳細
申込み研究会 CAS 
会議コード 2021-01-CAS-ICTSSL 
本文の言語 日本語 
タイトル(和) チャージポンプの入力電圧源の切り替えによる小面積化および段数可変による効率改善 
サブタイトル(和)  
タイトル(英) Reducing chip area and improving efficiency of a charge pump by switching the input voltage source and controlling the number of stages 
サブタイトル(英)  
キーワード(1)(和/英) 電源回路 / Power supply circuit  
キーワード(2)(和/英) チャージポンプ / Charge Pump  
キーワード(3)(和/英) 効率改善 / Improving efficiency  
キーワード(4)(和/英) 省チップ専有面積 / Reducing chip area  
キーワード(5)(和/英) /  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 廣永 駿輔 / Shunsuke Hironaga / ヒロナガ シュンスケ
第1著者 所属(和/英) 山梨大学 (略称: 山梨大)
University of Yamanashi (略称: Yamanashi Univ)
第2著者 氏名(和/英/ヨミ) 佐藤 隆英 / Takahide Sato / サトウ タカヒデ
第2著者 所属(和/英) 山梨大学 (略称: 山梨大)
University of Yamanashi (略称: Yamanashi Univ)
第3著者 氏名(和/英/ヨミ) 小川 覚美 / Satomi Ogawa / オガワ サトミ
第3著者 所属(和/英) 山梨大学 (略称: 山梨大)
University of Yamanashi (略称: Yamanashi Univ)
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講演者 第1著者 
発表日時 2021-01-29 13:40:00 
発表時間 25分 
申込先研究会 CAS 
資料番号 CAS2020-64, ICTSSL2020-49 
巻番号(vol) vol.120 
号番号(no) no.346(CAS), no.347(ICTSSL) 
ページ範囲 pp.130-135 
ページ数
発行日 2021-01-21 (CAS, ICTSSL) 


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