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講演抄録/キーワード
講演名 2022-01-25 10:20
マイクロ波レーダを用いたウォークスルーセキュリティ検査システムにおけるイメージング処理のFPGA実装
住谷達哉小林悠記有吉正行NECVLD2021-64 CPSY2021-33 RECONF2021-72
抄録 (和) 公共交通機関や商業ビルのような多くの人が行き交う施設の安全性と利便性を両立するため,筆者らは利用者の動きを止めずに歩きながら検査を行う「ウォークスルーセキュリティ検査システム」を開発している.本システムはマイクロ波レーダを用いて検査対象の透過画像を生成(イメージング)し,手荷物や衣服下などに隠された危険物を見つけだす.イメージング処理は多くの演算を要するのに加えて,動く検査対象への見落としがないように高い画像更新頻度(10fps以上)で動作させる必要もある.開発した試作機では大型のGPUで高速処理を行っているが,実用化にあたっては装置全体の小型化が望ましい.そこで本稿では,小型化に有利なFPGAによるイメージング処理の実装および性能評価を行った.その結果,適切な並列処理設計やリソース削減等に寄与する実装工夫により,10fps動作を実現する約70ms (<100ms)の処理時間でイメージングできる見込みが得られた. 
(英) To enhance security at facilities such as railway stations and commercial buildings where many people come and go without losing user convenience, we have developed a walk-through security screening system which does not require people to stop walking. This system generates images of the screening target based on microwave radar, and detects concealed dangerous objects from those images. Imaging function needs a large amount of processing, and in addition a high frame rate (at least 10 fps) is also required to screen the moving target. Although our current prototype works on a large GPU server, it is desirable to minimize the entire system for practical applications. Therefore, we focus on FPGA that has advantage in minimization, and implement imaging processing on it. With appropriate parallel processing design and implementation, it is confirmed that imaging runs within 70 ms (<100 ms), which is fast enough to achieve 10 fps rate.
キーワード (和) イメージング / レーダ / FPGA / セキュリティ検査 / / / /  
(英) Imaging / Radar / FPGA / Security Screening / / / /  
文献情報 信学技報, vol. 121, no. 344, RECONF2021-72, pp. 84-89, 2022年1月.
資料番号 RECONF2021-72 
発行日 2022-01-17 (VLD, CPSY, RECONF) 
ISSN Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード VLD2021-64 CPSY2021-33 RECONF2021-72

研究会情報
研究会 RECONF VLD CPSY IPSJ-ARC IPSJ-SLDM  
開催期間 2022-01-24 - 2022-01-25 
開催地(和) オンライン開催 
開催地(英) Online 
テーマ(和) FPGA 応用および一般 
テーマ(英) FPGA Applications, etc. 
講演論文情報の詳細
申込み研究会 RECONF 
会議コード 2022-01-RECONF-VLD-CPSY-ARC-SLDM 
本文の言語 日本語 
タイトル(和) マイクロ波レーダを用いたウォークスルーセキュリティ検査システムにおけるイメージング処理のFPGA実装 
サブタイトル(和)  
タイトル(英) FPGA Implementation of Radar Imaging for Walk-Through Security Screening System 
サブタイトル(英)  
キーワード(1)(和/英) イメージング / Imaging  
キーワード(2)(和/英) レーダ / Radar  
キーワード(3)(和/英) FPGA / FPGA  
キーワード(4)(和/英) セキュリティ検査 / Security Screening  
キーワード(5)(和/英) /  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 住谷 達哉 / Tatsuya Sumiya / スミヤ タツヤ
第1著者 所属(和/英) 日本電気株式会社 (略称: NEC)
NEC Corporation (略称: NEC)
第2著者 氏名(和/英/ヨミ) 小林 悠記 / Yuki Kobayashi / コバヤシ ユウキ
第2著者 所属(和/英) 日本電気株式会社 (略称: NEC)
NEC Corporation (略称: NEC)
第3著者 氏名(和/英/ヨミ) 有吉 正行 / Masayuki Ariyoshi / アリヨシ マサユキ
第3著者 所属(和/英) 日本電気株式会社 (略称: NEC)
NEC Corporation (略称: NEC)
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講演者 第1著者 
発表日時 2022-01-25 10:20:00 
発表時間 25分 
申込先研究会 RECONF 
資料番号 VLD2021-64, CPSY2021-33, RECONF2021-72 
巻番号(vol) vol.121 
号番号(no) no.342(VLD), no.343(CPSY), no.344(RECONF) 
ページ範囲 pp.84-89 
ページ数
発行日 2022-01-17 (VLD, CPSY, RECONF) 


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