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| 講演抄録／キーワード | ||
| 講演名 | 2022-03-01 09:30 スタンダードセル設計を用いた逐次比較型ADCの自動設計 ○平野皓士・小松 聡（東京電機大）  DC2021-64 |
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| 抄録 | （和） | スマートフォンや IoT 端末の普及により，半導体の需要が急速に高まっている．特に ADC は，半導体が実世界を観測するのに不可欠な回路であり，さまざまな半導体内部に組み込まれている．本研究では回路面積が小さく低消費電力で動作可能な容量型 DAC を用いた逐次比較型 ADC をデジタル回路設計において技術が確立されているスタンダードセル設計を用いることで，レイアウトの自動設計まで可能にする設計自動化環境を提案する．提案フローより，分解能を変化させてもレイアウトが生成可能であることを確認した． |
| （英） | The spread of smartphones and IoT devices has led to a rapid increase in demand for semiconductors. In particular, ADCs are essential circuits for semiconductors to observe the real world, and are embedded inside a wide variety of semiconductors. In this research, a capacitive successive approximation ADC, which has a small circuit area and can operate with low power consumption, has been established with digital circuit design flow. The layout of the ADC was automatically designed by using standard cell design, and we confirmed that the layout can be generated even when the resolution is of the ADC changed | |
| キーワード | （和） | スタンダードセル / ADC / 逐次比較 / 自動設計 / 容量型 DAC 回路 / / / |
| （英） | Standard Cell / ADC / Successive Approximation / Automatic Design / Capacitive DAC Circuit / / / | |
| 文献情報 | 信学技報, vol. 121, no. 388, DC2021-64, pp. 1-6, 2022年3月. | |
| 資料番号 | DC2021-64 | |
| 発行日 | 2022-02-22 (DC) | |
| ISSN | Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | DC2021-64 |
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| 研究会情報 | |
| 研究会 | DC |
| 開催期間 | 2022-03-01 - 2022-03-01 |
| 開催地（和） | 機械振興会館 |
| 開催地（英） | Kikai-Shinko-Kaikan Bldg. |
| テーマ（和） | VLSI設計とテストおよび一般 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | DC |
| 会議コード | 2022-03-DC |
| 本文の言語 | 日本語 |
| タイトル（和） | スタンダードセル設計を用いた逐次比較型ADCの自動設計 |
| サブタイトル（和） | |
| タイトル（英） | Design of Successive Approximation ADC using Standard Cell Design Flow |
| サブタイトル（英） | |
| キーワード(1)（和/英） | スタンダードセル / Standard Cell |
| キーワード(2)（和/英） | ADC / ADC |
| キーワード(3)（和/英） | 逐次比較 / Successive Approximation |
| キーワード(4)（和/英） | 自動設計 / Automatic Design |
| キーワード(5)（和/英） | 容量型 DAC 回路 / Capacitive DAC Circuit |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 平野 皓士 / Hiroshi Hirano / ヒラノ ヒロシ |
| 第1著者 所属（和/英） | 東京電機大学 (略称： 東京電機大) Tokyo Denki University (略称： Tokyo Denki Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 小松 聡 / Satoshi Komatsu / コマツ サトシ |
| 第2著者 所属（和/英） | 東京電機大学 (略称： 東京電機大) Tokyo Denki University (略称： Tokyo Denki Univ.) |
| 講演者 | 第1著者 |
| 発表日時 | 2022-03-01 09:30:00 |
| 発表時間 | 25分 |
| 申込先研究会 | DC |
| 資料番号 | DC2021-64 |
| 巻番号（vol） | vol.121 |
| 号番号（no） | no.388 |
| ページ範囲 | pp.1-6 |
| ページ数 | 6 |
| 発行日 | 2022-02-22 (DC) |
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