研究会開催プログラム - 2025-03-HWS-ICD-VLD

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集積回路研究会（ICD）

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専門委員長		池田誠 (東大)
副委員長		若林準人 (ソニーセミコンダクタソリューションズ)
幹事		吉原義昭 (キオクシア)，塩見準 (阪大)
幹事補佐		白井僚 (京大)，高野恭弥 (東京理科大)，久保木猛 (熊本大)

VLSI設計技術研究会（VLD）

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専門委員長		桜井祐市 (日立)
副委員長		冨山宏之 (立命館大)
幹事		笹川幸宏 (ソシオネクスト)，瀬戸謙修 (熊本大)
幹事補佐		西元琢真 (日立)，田中亜実 (立命大)，小田川真之 (日本ケイデンスデザインシステムズ)

ハードウェアセキュリティ研究会（HWS）

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専門委員長		林優一 (奈良先端大)
副委員長		秋下徹 (ソニーセミコンダクタソリューションズ)，三浦典之 (阪大)
幹事		佐藤俊寛 (エッチ・ディー・ラボ)，坂本純一 (産総研)

日時	2025年 3月 5日(水)　14:00 - 17:10 2025年 3月 6日(木)　09:45 - 17:10 2025年 3月 7日(金)　09:45 - 16:45 2025年 3月 8日(土)　09:20 - 12:30
議題	システムオンシリコンを支える設計技術, ハードウェアセキュリティ, 一般
会場名	みんなの貸会議室那覇旭町店
住所	〒900-0029 沖縄県那覇市旭町114-5
交通案内	https://minnanospace.com/naha-asahimachi-space/
参加費について	この開催は「技報完全電子化」研究会です．参加費（HWS研究会, ICD研究会, VLD研究会）についてはこちらをご覧ください．
参加費支払い手続き期限	本研究会はハイブリッド開催です．準備の都合上，原則として開催の3日前までに受付を終了しますので，「参加費について」の聴講参加費または年間登録費のリンクからお早めにお手続きください．当日会場での現金受付はございません．なお，会議用URLなどは研究会幹事からご案内します．
オンライン開催聴講申込	こちらのフォームからお申し込みください．

3月5日(水) 【VLD】バイオチップ設計 14:00 - 15:15
(1)	14:00-14:25	DMFBにおけるノードレベルを考慮したノード二重化によるエラー訂正手法	○鈴木皓貴・山下　茂・冨山宏之（立命館大）・Ankur Gupta（NSUT）
(2)	14:25-14:50	MEDAにおける分割を考慮したルーティング手法のダイクストラ法による高速化	○中村一晴・山下　茂・冨山宏之（立命館大）・Ankur Gupta（NSUT）
(3)	14:50-15:15	MEDAバイオチップのための高速液滴運搬アルゴリズムの提案	○プレブダガバエムン・下田将之・田湯　智・高橋篤司（Science Tokyo）
	15:15-15:30	休憩　（ 15分）
3月5日(水) 【VLD】配置配線・機械学習応用 15:30 - 17:10
(4)	15:30-15:55	ランダムフォレストを用いた類似文字列分類によるモチーフ抽出法の提案	○村田時源・稲木雅人・ルカックマーティン・若林真一・永山　忍（広島市大）
(5)	15:55-16:20	製造業におけるピッキング部品配置の最適化	○中山夏実・稲木雅人・ルカックマーティン・若林真一・永山　忍（広島市大）
(6)	16:20-16:45	4層U字型ボトルネックチャネル配線に関する一考察	○坂倉　耀・田湯　智・下田将之・高橋篤司（Science Tokyo）
(7)	16:45-17:10	グラフニューラルネットワークを用いた大規模アナログ回路のアナログプリミティブセル識別手法	○ゴンチャオ・中武繁寿（北九州市大）
3月6日(木) 【VLD】システム設計1 09:45 - 11:00
(8)	09:45-10:10	AXI Liteを用いた同期式回路から非同期式回路へのデータ転送の検討	○仙波翔吾・齋藤　寛（会津大）
(9)	10:10-10:35	Network on Chipに基づく汎用画像処理アーキテクチャとその評価	○三好隼人・吉原蓮人・門田龍弥・川上寛人・近藤真史（岡山理科大）
(10)	10:35-11:00	Chipyardを用いたRISC-Vプロセッサにおけるsort命令の実現	○増田大輝・武内良典（近畿大）
	11:00-11:15	休憩　（ 15分）
3月6日(木) 【VLD】演算回路 11:15 - 12:30
(11)	11:15-11:40	区間分割に基づくビット操作を利用した小面積かつ高精度なSC演算回路の検討	○柳田陽太・山下　茂（立命館大）
(12)	11:40-12:05	二値化NNの畳み込み計算におけるポップカウントの高効率LSI実装	○菊池怜士・伊藤和人（埼玉大）
(13)	12:05-12:30	二値化NNの畳み込みとプーリング処理のレジスタブリッジ型LSIによる実装	○岩井悠一郎・伊藤和人（埼玉大）
	12:30-14:00	休憩　（ 90分）
3月6日(木) 【HWS】実装・サイドチャネル評価 14:00 - 15:15
(14)	14:00-14:25	単一RNS基底によるモンゴメリ乗算アルゴリズムの応用に向けた検討	○川村信一（産総研）・駒野雄一（千葉工大）
(15)	14:25-14:50	共通鍵暗号の光回路化に向けた実装アーキテクチャの提案と回路作製	○高橋順子・北　翔太・新家昭彦（NTT）・青木和麻呂（文教大）・千田浩司（群馬大）・星野文学（長崎県立大）
(16)	14:50-15:15	ネットリストへのサイドチャネル攻撃プラットフォームを用いた耐タンパ性設計の再評価	○勝部諒真・請園智玲（福岡大）
	15:15-15:30	休憩　（ 15分）
3月6日(木) 【VLD】表彰式・アクセラレータ設計 15:30 - 17:10
(17)	15:30-15:55	［記念講演］大規模搬送ロボットシステムの経路最適化のためのマルチFPGAを用いたSQAアクセラレーションに関する研究	○NguyenQuang Thinh・松山公丞（東北大学）・清水啓介・菅野裕己・栗本英治（シャープ株式会社）・WAIDYASOORIYA Hasitha Muthumala・張山昌論・大関真之（東北大学）
(18)	15:55-16:20	Single-Source Shortest Path FPGA Accelerator Using Multiple Parallel Searches with High-Level Synthesis and Linked List Implementation	○Haopeng Meng・Kazutoshi Wakabayashi・Makoto Ikeda（The University of Tokyo）
(19)	16:20-16:45	SoC FPGA向けS/W-H/W分割支援方式についての検討 [変更あり]	○村野弘樹・山本　亮・森井貴大・遠山　治（三菱電機）
(20)	16:45-17:10	メモリアクセスを考慮したレジスタブリッジ型LSIのマッピング・スケジューリング手法	○明石想太・伊藤和人（埼玉大）
3月7日(金) 【VLD】機械学習と時系列解析 09:45 - 11:00
(21)	09:45-10:10	消費電力波形の形状に基づくクラスタリングによるIoTデバイス異常動作検知手法	○川村竜太・江田琉聖・中西　響・戸川　望（早大）
(22)	10:10-10:35	オートエンコーダの再構成誤差を用いたFPGA異常動作検出手法	○五百森　颯・江田琉聖・戸川　望（早大）
(23)	10:35-11:00	CNN, BNN, TNN, SNNを用いた心音分類の性能評価	○谷口怜央・古田暖人・中武繁寿（北九州市大）
	11:00-11:15	休憩　（ 15分）
3月7日(金) 【VLD】ハードウェアセキュリティ 11:15 - 12:30
(24)	11:15-11:40	Responseを再利用したMTJ-PUFの提案と機械学習攻撃耐性の評価	○塚田大貴・宇佐美公良（芝浦工大）
(25)	11:40-12:05	ハードウェアトロイ検出を可能にする細粒度電源ドメイン分割回路の低コスト化	○石川貴大・御堂義博・三浦典之（阪大）・新谷道広（京都工繊大）・塩見　準（阪大）
(26)	12:05-12:30	低温環境下におけるトランジスタ特性を用いたハードウェアトロイの開発	○高谷彩乃・中島隆一（京都工繊大）・塩見　準（阪大）・新谷道広（京都工繊大）
	12:30-14:25 [変更あり]	休憩　（ 115分） [変更あり]
3月7日(金) 【HWS】実装・電磁注入/観測 14:25 - 15:15 [変更あり]
(27) [変更あり]	14:25-14:50	暗号モジュールに対する故障注入対策に向けた複数PLLの適用手法に関する検討	○西山　輝（産総研/奈良先端大）・藤本大介・林　優一（奈良先端大）
(28) [変更あり]	14:50-15:15	NTTの高速化に向けたLUTリダクション型バタフライ演算器のパイプライン設計	○小泉理久・藤本大介・林　優一（奈良先端大）
	15:15-15:30	休憩　（ 15分）
3月7日(金) 【VLD/ICD】システム設計2 15:30 - 16:45
(29) [変更あり]	15:30-15:55	極低温環境におけるFPGA評価ボードの性能評価	○高嶋智規・斉藤旭晟・今井　雅（弘前大）
(30) [変更あり]	15:55-16:20	量子アニーリングシミュレータと回路シミュレータの統合と有用性評価	○斉藤旭晟・今井　雅（弘前大）
(31) [変更あり]	16:20-16:45	MSS-CMOS三次元積層による小型マルチモーダル嗅覚デバイス	○加藤　成・成瀬厚太郎・松森拓馬・塩見　準・御堂義博・廣瀬哲也（阪大）・今村　岳（阪大/NIMS）・吉川元起（筑波大/NIMS）・三浦典之（阪大）
3月8日(土) 【HWS】サイドチャネル攻撃 09:20 - 10:35
(32) [変更あり]	09:20-09:45	Kolmogorov-Arnold Networksを用いた解釈可能な深層学習サイドチャネル解析	○吉田康太（立命館大）・Sengim Karayalcin（Leiden Univ.）・Stjepan Picek（Radboud Univ.）
(33) [変更あり]	09:45-10:10	CAN信号を波形取得のトリガとする車載ECUに対するサイドチャネル攻撃環境構築	○加藤友恵・福田悠太・長久瑞樹・奥田将登・吉田康太・藤野　毅（立命館大）
(34) [変更あり]	10:10-10:35	オートエンコーダを活用した前処理による深層学習手法を用いるサイドチャネル攻撃の軽量化	○森田昌樹・小島拓也・石井悠人・高瀬英希・中村　宏（東大）
	10:35-10:50	休憩　（ 15分）
3月8日(土) 【HWS】IoTセキュリティ 10:50 - 12:30
(35) [変更あり]	10:50-11:15	Hardware-Assisted IoT Security: Real-Time DDoS Detection through Power Side-Channel Analysis	○Qingyu Zeng・Mingyu Yang・Yuko Hara（Science Tokyo）
(36) [変更あり]	11:15-11:40	フォールト攻撃脆弱性検出ツールの定量比較	○梨本翔永（三菱電機）
(37) [変更あり]	11:40-12:05	ハードウェアトロイに対するハイブリッドかつ階層的な検知フローの検討	○隠岐貴文・長谷川陸宇・門田和樹・三木拓司・永田　真（神戸大）
(38) [変更あり]	12:05-12:30	デバイス固有性を利用した監視カメラ用計測セキュリティ技術の拡張性評価	○成瀬厚太郎・御堂義博・三浦典之（阪大）

講演時間
一般講演	発表 20 分＋質疑応答 5 分

問合先と今後の予定
ICD	集積回路研究会（ICD） [今後の予定はこちら]
	問合先	白井僚（京都大学） E-: iik-u
VLD	VLSI設計技術研究会（VLD） [今後の予定はこちら]
	問合先	笹川幸宏（ソシオネクスト）
	お知らせ	◎VLD研究会ホームページもご覧下さい． http://www.ieice.org/~vld/
HWS	ハードウェアセキュリティ研究会（HWS） [今後の予定はこちら]
	問合先	坂本純一（産総研）, 佐藤俊寛(エッチ・ディー・ラボ) E-:hws-c