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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| HWS | 2023-04-14 13:45 |
大分 | 湯布院公民館 （ハイブリッド開催，主：現地開催，副：オンライン開催） |
剰余乗算器からのサイドチャネル情報漏洩においてRNSを用いた実装の並列数が与える影響に関する基礎検討 ○藤本大介・芳賀陸雄・林 優一（奈良先端大）  HWS2023-2 |
公開鍵暗号においてエネルギー効率が良い実装としてResidue Number System (RNS)を用いたハードウェ... [more] | HWS2023-2 pp.6-8 |
| SDM, ICD (共催) ITE-IST (連催) [詳細] |
2021-08-18 13:45 |
ONLINE | オンライン開催 | シリアル-パラレル形モンゴメリ乗算器の性能評価 ○壷内博幸・金城光永・島袋勝彦（琉球大） SDM2021-40 ICD2021-11 |
高速演算が可能な剰余数系ではモジュロ演算を行う必要がある．一方，乗算剰余算として，時間のかかる除算を行わず加減算, 乗算... [more] | SDM2021-40 ICD2021-11 pp.54-57 |
| HWS, ISEC, SITE, ICSS, EMM (共催) IPSJ-CSEC, IPSJ-SPT (共催) (連催) [詳細] |
2018-07-26 15:25 |
北海道 | 札幌コンベンションセンター | パス遅延故障に基づくハードウェアトロイの系統的挿入法とその評価 ○伊東 燦・上野 嶺・本間尚文・青木孝文（東北大） ISEC2018-44 SITE2018-36 HWS2018-41 ICSS2018-47 EMM2018-43 |
本稿では，パス遅延故障に基づくハードウェアトロイ(PDHT: Path Delay Hardware Trojan) の... [more] | ISEC2018-44 SITE2018-36 HWS2018-41 ICSS2018-47 EMM2018-43 pp.349-356 |
| SCE | 2014-01-24 13:40 |
東京 | 機械振興会館地下3階2号室 | 木構造部分積加算回路をもつSFQ並列乗算器における最終加算回路の比較 ○山田朗文・小野美 武・中島康治（東北大） SCE2013-52 |
単一磁束量子(SFQ)回路は数十GHzでの高速動作が可能であり，発熱量，消費電力の面でも半導体回路に比べ大きな優位性をも... [more] | SCE2013-52 pp.101-104 |
| EMCJ | 2013-04-12 11:55 |
岡山 | 岡山大 | Low Power CSSAL Bit-Parallel Multiplier over GF(2^4) in 0.18 um CMOS Technology ○Cancio Monteiro・Yasuhiro Takahashi・Toshikazu Sekine（Gifu Univ.） EMCJ2013-3 |
In this paper, we show the post layout simulation result of ... [more] | EMCJ2013-3 pp.13-18 |
| VLD, DC, IPSJ-SLDM (共催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2008-11-18 10:55 |
福岡 | 北九州学術研究都市 | 配線遅延を考慮した回路モデル上でのハードウェアアルゴリズムの評価 ○長瀬哲也・高木一義・高木直史（名大） VLD2008-77 DC2008-45 |
集積回路設計において，計算時間や面積などの要求に応じてハードウェアアルゴリズムを設計，選択することが重要となる．従来のハ... [more] | VLD2008-77 DC2008-45 pp.103-108 |
| COMP | 2007-12-14 14:50 |
広島 | 広島大学 | 配線遅延を考慮したハードウェアアルゴリズムの評価 ○長瀬哲也・高木一義・高木直史（名大） COMP2007-51 |
従来，ハードウェアアルゴリズムの計算時間は，組合せ回路モデルにおける回路の段数により評価してきた．回路の各論理素子での遅... [more] | COMP2007-51 pp.23-28 |
| CAS, SIP, VLD (共催) |
2007-06-22 13:20 |
北海道 | 北海道東海大学 札幌キャンパス マルチメディアホール | 並列プレフィックス加算器を用いた算術演算モジュールの自動生成 ○渡邉裕樹・本間尚文・青木孝文（東北大）・樋口龍雄（東北工大） CAS2007-27 VLD2007-43 SIP2007-57 |
本稿では，並列プレフィックス加算器を用いた演算器モジュールジェネレータについて述べる．提案するシステムは，演算器内部の並... [more] | CAS2007-27 VLD2007-43 SIP2007-57 pp.49-54 |
| RECONF | 2005-05-13 15:45 |
京都 | 京都大学 | 動的リコンフィギャラブルプロセッサDRPに適した固定小数演算方法の検討 ○宮田美和・柴田裕一郎・小栗 清（長崎大） |
NECエレクトロニクス社のDRPは浮動小数ユニットを備えていないが、単一構成面に演算ユニットや分散配置された小規模なメモ... [more] | RECONF2005-25 pp.61-66 |
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