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研究会
発表日時
開催地
タイトル・著者
抄録
資料番号
ICD
,
IE
,
VLD
(共催)
IPSJ-SLDM
(連催)
[詳細]
2015-10-27
09:00
宮城
一の坊(作並温泉)
[チュートリアル招待講演]リアルワールド応用知能システムとそのVLSIコンピューティングプラットフォームの展望
○
亀山充隆
(
東北大
)
VLD2015-33 ICD2015-46 IE2015-68
今後のICT応用の1つとして,人間を支援するリアルワールド応用知能システムの意義とその実現について展望する.リアルワール...
[more]
VLD2015-33
ICD2015-46
IE2015-68
pp.37-42
RECONF
2014-06-12
10:50
宮城
片平さくらホール
LEDR/4相2線ハイブリッドアーキテクチャに基づく高性能非同期FPGA
○
小松与志也
・
張山昌論
・
亀山充隆
(
東北大
)
RECONF2014-6
本論文では非同期式データ転送プロトコルである4相2線方式とLevel-Encoded Dual-Rail (LEDR) ...
[more]
RECONF2014-6
pp.27-30
IE
,
ICD
,
VLD
(共催)
IPSJ-SLDM
(連催)
[詳細]
2013-10-08
10:35
青森
弘前大学 コラボ弘大
電流モード論理に基づく多値細粒度リコンフィギャラブルVLSIの新概念アーキテクチャ
○
白 旭
・
亀山充隆
(
東北大
)
VLD2013-57 ICD2013-81 IE2013-57
本稿では、多値Xネット・データ転送方式に基づく細粒度リコンフィギャラブルVLSIを提案している。2つの2値データは2個の...
[more]
VLD2013-57
ICD2013-81
IE2013-57
pp.59-64
VLD
,
DC
,
IPSJ-SLDM
(連催)
ICD
,
CPM
(共催)
CPSY
,
RECONF
(併催)
[詳細]
2012-11-27
17:00
福岡
九州大学百年講堂
[基調講演]動的再構成プロセッサ(DRP)技術の現状と今後の展望
○
本村真人
(
北大
)・
古田浩一朗
・
粟島 亨
・
志田靖斉
(
ルネサス エレクトロニクス
)
VLD2012-87 CPM2012-117 ICD2012-81 CPSY2012-55 DC2012-53 RECONF2012-49
DRPは、(1)小規模なプロセッサとメモリを2次元アレイ状に配置して自在にデータの処理・受け渡し・格納を可能にしたアーキ...
[more]
VLD2012-87
CPM2012-117
ICD2012-81
CPSY2012-55
DC2012-53
RECONF2012-49
p.163(VLD), p.29(CPM), p.29(ICD), p.45(CPSY), p.163(DC), p.15(RECONF)
IE
,
SIP
,
ICD
,
VLD
,
IPSJ-SLDM
(共催)
[詳細]
2012-10-19
09:25
岩手
ホテルルイズ(盛岡)【変更】
コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成
○
藤岡与周
(
八戸工大
)・
亀山充隆
(
東北大
)
VLD2012-47 SIP2012-69 ICD2012-64 IE2012-71
動的再構成VLSIプロセッサのコンフィグレーションメモリ容量のサイズを大幅に減少するために,レジスタトランスファレベルパ...
[more]
VLD2012-47
SIP2012-69
ICD2012-64
IE2012-71
pp.39-44
ICD
,
IPSJ-ARC
(連催)
2012-01-20
15:10
東京
電通大
同期/非同期ハイブリッドアーキテクチャに基づく低消費電力FPGAの評価
○
小松与志也
・
張山昌論
・
石原翔太
・
土屋亮人
・
亀山充隆
(
東北大
)
ICD2011-142
本論文では回路の稼働率に応じて同期式あるいは非同期式に回路の動作を選択できるハイブリッドFPGAを提案する.ロジックブロ...
[more]
ICD2011-142
pp.93-96
ICD
,
IE
,
SIP
(共催)
IPSJ-SLDM
(連催)
[詳細]
2011-10-24
14:45
宮城
一の坊(仙台)
レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ
○
藤岡与周
(
八戸工大
)・
瀧沢 翔
・
亀山充隆
(
東北大
)
SIP2011-64 ICD2011-67 IE2011-63
動的再構成VLSIプロセッサのコンフィグレーションメモリ容量のサイズを大幅に減少するために,レジスタトランスファレベルパ...
[more]
SIP2011-64
ICD2011-67
IE2011-63
pp.13-18
RECONF
2010-09-17
10:15
静岡
静岡大学(工学部2号館)
同期/非同期ハイブリッドアーキテクチャに基づく低消費電力FPGAの構成
○
石原翔太
・
土屋亮人
・
小松与志也
・
張山昌論
・
亀山充隆
(
東北大
)
RECONF2010-33
非同期式回路はクロックツリーによる消費電力がないため,低稼働率の部分回路において電力効率が良い.一方,同期式回路は非同期...
[more]
RECONF2010-33
pp.91-95
VLD
,
IPSJ-SLDM
(連催)
2010-05-19
17:00
福岡
北九州国際会議場
誤り伝播に着目した粗粒度再構成可能アーキテクチャ向け部分的三重化手法
○
湯浅洋史
・
今川隆司
・
廣本正之
・
越智裕之
・
佐藤高史
(
京大
)
VLD2010-4
近年のプロセス微細化や低電圧化に伴い,大容量SRAMはもとより,演算回路や制御回路内でもソフトエラーの発生率が増加してい...
[more]
VLD2010-4
pp.37-42
RECONF
2009-09-18
13:35
栃木
宇都宮大学
LEDR/4相2線プロトコルコンバータを用いた非同期FPGAの構成
○
石原翔太
・
小松与志也
・
張山昌論
・
亀山充隆
(
東北大
)
RECONF2009-36
本稿は4相2線方式とLEDR方式を組み合わせた非同期ハイブリッドFPGAを提案する.演算回路において,小面積性を実現する...
[more]
RECONF2009-36
pp.103-108
SIS
2009-06-12
10:35
沖縄
沖縄県久米島町立具志川農村環境改善センター
4x4 MIMO-OFDM受信機における動的再構成可能なMMSE検出器のLSI設計
○
池内博一
・
吉澤真吾
・
宮永喜一
(
北大
)
SIS2009-14
本報告では4x4MIMO-OFDM受信機における動的再構成可能なMMSE検出器のVLSIアーキテクチャを提案する.MIM...
[more]
SIS2009-14
pp.79-84
VLD
,
DC
,
IPSJ-SLDM
(共催)
ICD
,
CPM
(共催)
CPSY
,
RECONF
(併催)
[詳細]
2008-11-17
15:40
福岡
北九州学術研究都市
柔軟な信頼性を実現する粗粒度再構成可能アーキテクチャの検討
○
高 永勲
・
Dawood Alnajjar
・
密山幸男
・
橋本昌宜
・
尾上孝雄
(
阪大/JST
)
VLD2008-73 DC2008-41
VLSI に要求される信頼性はアプリケーションと動作環境に依存するため、VLSI 設計者には信頼性を考慮した設計が求めら...
[more]
VLD2008-73
DC2008-41
pp.79-84
ICD
,
IPSJ-ARC
(共催)
2008-05-14
11:15
東京
日立中央研究所
強誘電体機能パスゲートを用いたマルチコンテクストフィールドプログラマブルVLSIの構成
○
井戸端紀彰
・
石原翔太
・
張山昌論
・
亀山充隆
(
東北大
)
ICD2008-28
マルチコンテクストFPGA(Field Programmable Gate Array)では, コンテクストを高速に切り...
[more]
ICD2008-28
pp.57-62
RCS
,
MoNA
,
WBS
,
SR
,
MW
(併催)
2007-03-09
09:20
神奈川
YRP
リコンフィギャラブルプロセッサを用いたビタビ復号における消費電力の適応的最適化に関する研究
○
岸本有玄
・
春山真一郎
・
中川正雄
(
慶大
)
SR2006-90
ビタビ復号をハードウェアで実現する研究は過去に行われてきたが、拘束長の変化といった、複数の復号条件に適応させるには複数の...
[more]
SR2006-90
pp.9-13
RECONF
2006-09-14
14:45
熊本
熊本大学 工学部百周年記念館
SRAMブロックを用いた論理回路のー構成手法
佐藤正幸
・
若松弘樹
(
ジェネシス・テクノロジー
)
FPGAを使い構造可変なテスタを基板上に構成した低消費電力基板型構造可変テスタが開発されている.このFPGAをSoCに実...
[more]
RECONF2006-23
pp.17-22
ICD
,
IPSJ-ARC
(共催)
2006-06-09
09:30
神奈川
NEC玉川ルネッサンスシティ
電圧・電流制御に基づく低電力化を指向した多値リコンフィギャラブルVLSI
○
岡田信彬
・
ハアク モハマッド ムニルル
・
亀山充隆
(
東北大
)
低電力化を達成するためのプログラマブルな機能を有する,多値ソースカップルドロジックを用いたリコンフィギャラブルVLSIを...
[more]
ICD2006-50
pp.57-61
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